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　　0 引言

　　通常情況下，帶通信號可以借由相對應的基帶信號表示，比如若使用Sm表示一個實的帶通信號，則該帶通信號可以表示為如下情況：

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　　其中Sl(t)為帶通信號S(t)相對應的基帶信號。一般情況下，信號Sl(t)是一個復值信號，由對應的實部與虛部構成，也即I路與Q路數據。并且我們也可以證明對于一個帶通系統函數，我們也有與之相對應的基帶系統函數。

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　　因此，現代基帶處理器也采用類似的方法首先處理處于基帶的數字數據，然后通過模擬基帶完成D/A轉化后，再發送給射頻器件完成上變頻與信號發射。圖1表示了WCDMA R-6協議中上下行方向上信號處理的過程。

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　　從圖中我們可以發現在數字基帶處理器首先接收上層單元傳送的bit數據流，然后對一組數據按某種規則進行映射，將bit流映射為符號。比如QPSK或者QAM等等。單獨的數字信號無法在帶通信道中傳輸，而且對于WCDMA而言，帶通信號大約占用5MHz的帶寬，不然就會對相鄰的工作頻點產生干擾，導致系統的總體性能下降。所以完成數據流到符號的轉換后，仍然需要通過成型濾波器降低信號的帶寬。

　　按照WCDMA協議，首先采用QPSK調制方式形成符號，然后再通過根升余弦濾波器處理，形成協議規定的基帶信號。下文簡要介紹原理，然后給出相應的ASIC設計。

　　1 基帶信號QPSK調制原理簡介與ASIC設計

　　QPSK調制屬于相位調制的一種。因此由上文提到的帶通信號一般表達式可知：

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　　基帶信號調制就是將bit數據轉化成了符號坐標[cos2π(m-1)/M，sin2π(m-1/M)]，其中g(t)為基帶脈沖成型后的信號，在成型濾波中介紹。

　　按照WCDMA 25.213 R-6協議規定，上行方向上對于碼片采用π/4QPSK的調制方式，將二進制碼片轉換為符號。首先在高層傳送的二進制數據包經過各種其它處理，如分段、打孔、交織、Turbo編碼、擴頻與加擾處理后，形成碼片，其速率達到3.84Mchip/s。一般對WCDMA基帶處理器而言，采用16倍的主時鐘對數字信號進行處理，即每16個clk對應一個碼片，每個碼片進行4個樣點的采樣，4個clk對應一個采樣。π/4QPSK星座圖如圖2所示。

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　　上圖中由于ASIC設計中定點化的需要，我們將1映射為1464即12’h5a8，而0映射為-1464即12’ha58。其ASIC設計如圖3所示。

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　　輸入信號為1bit數據流，每隔4個clk計數器產生使能信號，進行數據流與符號之間的轉換運算。如此便形成了調制后的基帶信號。數字信號無法在帶通行道中傳輸，所以還需要成型濾波器對減少信號的ISI與控制信號帶寬。即在上文中提到的g(t)。

　　2 成型濾波器

　　在帶限信道傳輸數據時，相鄰符號間會產生符號間干擾。采用合適的成型濾波器可以有效地減小符號間干擾。按3GPP協議中規定，對于QPSK調制，采用升余弦脈沖成型濾波器。RC濾波器可以有效減小符號間串擾ISI，有效地減少信息傳輸的帶寬。同時也是QPSK調制信號成形濾波器，滾降系數a=0.22，調制后信號帶寬為(1+a)/2T，其中T≈0.26042μs，計算后可得其基帶信號有效帶寬約為4.6847MHz，協議規定為5MHz。下面給出升余弦脈沖成型濾波器的頻率域函數。此函數是連續的，但是數字基帶濾波器輸出的是離散的數字信號，所以下面我們要將升余弦脈沖成型濾波器轉換為數字濾波器的形式。

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　　在進行轉換之前，考慮到匹配濾波的情況，我們還可以進一步將該升余弦脈沖成型濾波器變換為兩個根升余弦脈沖成型濾波器。并且將其放置于發射機與接收機。根升余弦脈沖成型濾波器的形式如下：

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　　通過軟件仿真我們可以發現其頻率幅度響應如圖6所示。

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　　由圖6我們可以發現離散信號在數字頻率域上的幅度響應范圍得到了一定的控制。再通過Fourier反變換，我們可以得其時域響應：

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　　該時域表達式對于時間軸對稱，所以物理無法實現，故需要引入一定相位延遲，并且考慮到對于時時通訊而言，線性相位具有非常重要的意義，所以我們可以采用FIR結構實現根升余弦脈沖成型濾波器，采用沖擊響應不變法，我們可以獲得根升余弦脈沖成型濾波器的時域離散值;圖7根升余弦成型濾波器時間離散域幅度。

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　　上圖中為了保證濾波器性能，我們采用了65階濾波器設計，因此我們只需要引入32個clk的延遲，就可以形成FIR形式的濾波器。并且因為是低通濾波器，我們采用基數階的系數。所以可得下式：

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　　由上式我們發現FIR結構濾波器系數，我們采用如下的結構實現根升余弦成犁濾波器的ASIC設計：

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　　由于FIR濾波器特有的線性相位特性，使得其前后濾波系數對稱。所以可以節約乘法器資源，減小資源。所以我們可以先將乘法系數相同的信號先相加，然后再與乘法系數相乘。

　　其輸入輸出時序圖如圖9所示。

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　　3 結論

　　本文簡要分析了WCDMA協議上行調制方向的數據處理方式與原理，然后給出了ASIC電路的實現。具有一定的理論參考價值和很強的實用性。在根升余弦成型濾波器中引入了延遲，使得根升余弦成型濾波器可以物理實現，并且采用了FIR結構可以有效地減少芯片資源的占用。