基于FPGA的安檢機圖像數(shù)據(jù)排序算法實現(xiàn)
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在傳統(tǒng)的安檢機數(shù)據(jù)采集傳輸系統(tǒng)中，控制芯片直接將AD采集的前端X射線探測器的數(shù)據(jù)傳輸?shù)?a target='_blank' class='arckwlink_none'>上位機中，然后上位機軟件冉對數(shù)據(jù)進(jìn)行排序整理然后再進(jìn)行圖像數(shù)據(jù)的處理，這樣不僅對上位機CPU增加了處理負(fù)擔(dān)，而且降低了圖像數(shù)據(jù)的處理速度，大大降低了安檢機的安檢效率；本設(shè)計利用FPGA的高速數(shù)據(jù)處理特性，通過對AD采集的前端雙能X射線探測器的圖像數(shù)據(jù)在雙端口RAM中進(jìn)行排序處理，然后通過以太網(wǎng)將排序好的圖像數(shù)據(jù)傳輸?shù)缴衔粰C中，這樣不僅降低了上位機CPU的占用率而且提高了上位機圖像處理的速度，使安檢機的實時性能得到更好的提高。
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