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Cadence宣布新的Tensilica Vision P6 DSP瞄準嵌入式神經網絡應用

PCB線路板打樣 ? 來源:LONG ? 2019-08-07 11:05 ? 次閱讀

與上一代Vision DSP相比,最新的DSP四倍神經網絡性能

加利福尼亞州圣何塞, 2016年5月2日/PRNewswire/--Cadence Design Systems,Inc。(納斯達克股票代碼:CDNS)今天宣布推出全新Cadence?Tensilica?VisionP6數字信號處理器(DSP),這是Cadence的最高性能視覺/成像處理器,將Tensilica產品組合進一步擴展到快速增長的視覺/深度學習應用領域。新指令,更高的數學吞吐量和其他增強功能為成像和計算機視覺基準設定了新標準,與Tensilica Vision P5 DSP相比,性能提高了4倍。

Tensilica Vision P6 DSP與上一代Vision P5 DSP相比,具有四倍的累加(MAC)性能,針對可用MAC性能主導的卷積神經網絡(CNN)應用。與商用GPU相比,Tensilica在典型的神經網絡實現中,Vision P6 DSP可以在低得多的功耗下實現兩倍的幀速率。對于廣泛的其他關鍵視覺功能,如卷積,FIR濾波器和矩陣乘法,Tensilica Vision P6 DSP利用其改進的8位和16位算法將性能提高了4倍,使其成為理想的DSP用于CNN應用。此外,Tensilica Vision P6實現了即時數據壓縮,大大減少了對要求苛刻的“完全連接”神經網絡層的內存占用和帶寬要求。

Tensilica Vision P6 DSP建立在勢頭上市場領先的Vision P5 DSP,已由兩家領先的移動電話應用處理器供應商設計。這款最新的視覺DSP與Vision P5 DSP兼容,提供可選的32路SIMD矢量浮點單元,包括IEEE半精度標準(FP16)。浮點性能是Vision P5 DSP的兩倍,可以輕松使用現有的浮點神經網絡實現。

Tensilica Vision P6 DSP的進步進一步提高了軟件開發和移植的便利性,全面支持整數,定點和浮點數據類型,以及帶有經過驗證的自動矢量化C編譯器的高級工具鏈。該軟件環境還完全支持標準OpenCV和OpenVX庫,支持超過1000個庫函數,支持現有成像/視覺應用程序的快速,高級別遷移。 Tensilica Vision P6 DSP的早期客戶參與預計將于6月底開始。

“Cadence在高級視覺和深度學習方面投入巨資,”Chris Rowen ,Cadence的IP集團首席技術官說。 “我們正致力于發現神經網絡的改進結構和培訓,為快速應用開發提供豐富的軟件環境,并為嵌入式視覺和學習部署提供突破性的視覺DSP架構.Tensilica Vision P6設計是這項投資的直接結果,這顯著提高了視覺效率和可擴展性的標準。“

”我們一直與Cadence密切合作開發基于CNN的視覺應用。具有寬矢量SIMD處理,VLIW指令,快速直方圖和分散/聚集內在函數使其成為要求CNN算法的理想平臺,“A說。 G. K. Karunakaran ,Multicoreware的總裁兼首席執行官。“Tensilica Vision DSP的性能特點,結合其高度調整的圖像處理庫和強大的開發環境,實現了我們算法的高效實施,縮短了我們的開發周期。我們很高興能繼續與Cadence合作新一代Vision P6 DSP。“

“更了解周圍世界的設備更強大,更自主,更安全,更易于使用,”嵌入式創始人Jeff Bier 說道。視覺聯盟。“通過廣泛部署深度學習和計算機視覺,像Tensilica Vision P6 DSP這樣的處理器正在實現更多智能設備的承諾。”

關于Cadence

Cadence實現全球電子設計創新并發揮必不可少的作用在創建當今集成電路電子產品方面的作用。客戶使用Cadence軟件,硬件,IP和服務來設計和驗證高級半導體消費電子產品,網絡和電信設備以及計算機系統。該公司總部位于加利福尼亞州圣何塞的,在全球設有銷售辦事處,設計中心和研究機構,為全球電子行業提供服務。

本新聞稿包含一些基于我們當前預期的前瞻性陳述,涉及眾多可能導致這些前瞻性陳述不準確的風險和不確定性。可能導致這些前瞻性陳述不準確的風險包括我們的美國證券交易委員會文件和報告中不時詳述的風險,包括但不限于我們最近的季度報告。 10-Q表格和10-K表格的年度報告。我們不打算更新本新聞稿中包含的信息

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