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工程師在設計pcb時要注意什么事項

PCB線路板打樣 ? 來源:互聯網 ? 作者:互聯網 ? 2019-11-15 11:16 ? 次閱讀

1.過度約束網絡。它會令信號難于布線。在極端情況下,特別是當需要添加額外層時,為克服類似時序或間距要求等相應的布線問題,設計時間可能會成倍延長。

2.在設計流程中間設定約束。重要的是要在任務開始時做這項工作。若選擇在后期階段為信號設置約束,你可能將不得不重新對PCB進行布線,因此將浪費大量時間。在布局和布線前,應計劃并處理好相關策略以保證不發生這種情況。

3.忘記關鍵網絡。若利用約束管理系統設置約束,在完成關鍵網絡的布線后再進行整個PCB的布線不失明智之舉——特別是當你為信號設定長度或延時約束時。否則,當對信號實施定長策略時,就不再有將其加長的余地了。

4.采用無法與布線工具進行互動及不能引入數據的報告系統的約束管理工具。設定約束和規則當然很好,但若必須手工查詢每一指派的約束,就會使采用約束管理工具的效用化為烏有。

5.施用與設計規則不一致的約束。設計師以滿足制造指導原則為依歸對PCB進行布線。若不對約束進行管理并與如為了更好的蝕刻效果設定的合適信號間距或為了最小化交叉干擾采用的良好層堆疊等設計指導原則一起采用,就會引發問題。某些工具允許在你的設計中自由地將任何約束施用于關鍵網絡;其它的則在設計周期的任何階段應用你的設計規則,所以它們是加強了的。無論哪種方式,當你施用約束時,請確保不違忤設計規則。

責任編輯:ct

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