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如何使用SPICE最簡單的方法檢查電路潛在穩(wěn)定性

Wildesbeast ? 來源:未知 ? 作者:Bruce Trump ? 2019-10-04 15:10 ? 次閱讀

SPICE是一種檢查電路潛在穩(wěn)定性問題的有用工具 。本文將介紹一種使用SPICE工具來檢查電路潛在穩(wěn)定性的簡單方法。

圖1是使用OPA211搭建 的一個同相放大器,在許多應(yīng)用中,只是對圖1做了較小的變動。R3和C1構(gòu)成了輸入級濾波器。R4是電路的輸出電阻,當(dāng)運(yùn)放輸出級連接到其它外部電路時,R4起到保護(hù)作用。CL用來等效5英尺電纜。

該電路的小信號階躍響應(yīng)或者方波的響應(yīng)曲線是檢查潛在穩(wěn)定性問題的最快捷和最簡單的方法。圖2是仿真電路。值得注意的是電路輸入端連接到地,輸入測試信號源直接連接到運(yùn)放的同相輸入端。輸入級的濾波器將延緩輸入信號的邊沿。如果你想知道一個鐘是如何產(chǎn)生鈴聲的,你應(yīng)該使用一個鐵錘敲擊它,而不是一個橡皮棒。

響應(yīng)曲線是在運(yùn)放的輸出端探測,而不是電路的Vout節(jié)點(diǎn)。R4和CL構(gòu)成了濾波器以至于Vout節(jié)點(diǎn)不能真正地顯示出運(yùn)放的過沖。為了檢查穩(wěn)定性,我們需要知道運(yùn)放是如何工作的。

注意到輸入信號的幅度是1mV(在運(yùn)放輸出端的幅度是4mV)。我們希望得到小信號的響應(yīng)曲線。若輸入信號是大信號,則會涉及到壓擺率的問題,將減小過沖,不能真正地反應(yīng)潛在的不穩(wěn)定性。

從仿真結(jié)果可以看出,在運(yùn)放的輸出端有接近27%的過沖,較大的過沖會導(dǎo)致運(yùn)放在任何條件下都是不穩(wěn)定的。假設(shè)這是一個二階穩(wěn)定系統(tǒng),它意味著接近38度的相移裕量。另外,注意到頻率響應(yīng)曲線中存在相當(dāng)大的尖峰,這是另一個潛在的不穩(wěn)定的跡象。幅度峰值在14MHz時出現(xiàn),其正好是時域上振鈴周期的倒數(shù)。普遍認(rèn)為,當(dāng)信號的過沖小于或等于20%時,相移裕量大于或等于45度,運(yùn)放就可以視為穩(wěn)定的。

有更多深層次的分析可以通過SPICE仿真得到,例如:通過開環(huán)波特圖找到相位裕量和增益。但是對于大多數(shù)簡單的電路,上文提到的是指示潛在不穩(wěn)定問題的非常好的方法。當(dāng)然,任何SPICE仿真都取決于運(yùn)放macro模型的準(zhǔn)確性。現(xiàn)有的最優(yōu)秀的SPICE模型都不可能是完美的。此外,電路的差異性,非理想的元部件,電路板布線帶來的寄生參數(shù),低質(zhì)量的電源退耦,都能夠影響電路的穩(wěn)定性。這就是為什么你應(yīng)該進(jìn)行電路的仿真并且做實(shí)際的測試,比較兩者之間的差異并進(jìn)行優(yōu)化。SPICE是一個很有價值且很有用的工具,但是不能完全依靠SPICE來檢測電路的潛在穩(wěn)定性,因為SPICE不能考慮到運(yùn)放實(shí)際應(yīng)用時的一些參數(shù)。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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