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ZYNQ的啟動流程

FPGA之家 ? 來源:FPGA之家 ? 作者:FPGA之家 ? 2022-05-07 09:41 ? 次閱讀

最近由于項目需要,要將bit文件固化到zedboard的flash中,使程序上電自啟,斷電不丟失。

我們知道,一般板級調試的時候都是直接下載bit流到FPGA就行,固化到Flash的話,也是先生成.mcs文件,然后下載到Flash即可。

但是在經過反復嘗試之后,發現對zynq系列好像行不通。

why?這得從zynq的啟動流程說起。

一、ZYNQ的啟動流程

ZYNQ7000 SOC 芯片可以從 FLASH 啟動,也可以從 SD 卡里啟動, 本節介紹程序 FLASH 啟動的方法。Zynq7000 SOC 芯片上電后,最先運行的是ARM端系統(PS)。然后再通過ARM系統軟件部分加載FPGA的比特流文件.bit至FPGA(PL),配置FPGA PL端的邏輯功能。ZYNQ 系統的啟勱流程如下:

ZYNQ啟動分為兩個階段

  • 第一階段是 BOOT ROM(ZYNQ廠家固化代碼)

  • 第二階段是 FSBL (First Stage Bootloader)SDK工具來制作。

經過以上兩個階段,PL端配置程序及應用程序才開始運行。

1.1 第一階段 (BOOT ROM)

  • 上電后,Zynq7000 SOC 會首先執行片內 Boot ROM 代碼,Boot ROM 代碼讀取 Boot mode 寄存器來判斷是哪一種啟動方式(SD card/QSPI Flash/JTAG)。

  • 確定好哪種啟勱方式后,Boot ROM 從相應的啟動設備(SD Card/QSPI Flash)加載 First Stage Bootloader (FSBL) 到On Chip Memory(OCM) RAM,并且將執行權交付給 FSBL。

1.2 第二階段 FSBL (First Stage Bootloader)

使用SDK 工具一步步生成 FSBL 代碼和可執行文件,結合代碼可知 FSBL 主要做了如下工作:

  • 初始化 CPU,初始化串口;

  • Processor System (PS) 一些控制器的初始化,如 MIO, PLL, CLK and DDR

  • 禁止 L1 Data Cache;

  • 注冊 ARM 中斷向量;

  • 通過 Boot mode 寄存器,判斷是哪種啟動方式。

1.2.1 QSPI Flash 啟動方式:

  • 初始化 QSPI Flash 控刢器;

  • 從 Flash 拷貝 system.bit 到 FPGA (如果 Flash 中存有 system.bit);

  • 從 QSPI Flash 拷貝應用程序的代碼到DDR3;

  • 調轉到應用程序執行;

1.2.2 SD Card 啟動方式:

  1. 初始化 SD 控刢器;

  2. 從 SD Card 拷貝 system.bit 到 FPGA (如果 BOOT.BIN 中存有 system.bit);

  3. 從 SD card 拷貝應用程序的代碼到 DDR3;

  4. 跳轉到應用程序執行;

1.2.3 JTAG 啟動方式,直接退出。

因此,對于Zynq系列的FPGA芯片來說,固化到Flash中的bit文件需要一個引導程序(也就是FSBL),才能被用來配置PL。實際上,FSBL會作為BootLoader和bit文件一起合成一個.bin或者.mcs文件,然后下載到Flash中,過程如下:

dfbfc284-cd9e-11ec-bce3-dac502259ad0.png

二、生成BOOT.bin或者BOOT.mcs

2.1 VIVADO操作

你應該已經有了一個完整的工程,接下來你需要添加并配置PS端,生成新的bit文件:

(1)建立一個新的塊設計(Create Block Design)

dfdaea82-cd9e-11ec-bce3-dac502259ad0.png

(2)添加ZYNQ7 Processing System

dff03734-cd9e-11ec-bce3-dac502259ad0.png

(3)雙擊所添加的zynq7,配置peripheral I/O,我們只保留Quad SPI Flash

e00a8058-cd9e-11ec-bce3-dac502259ad0.jpg

(4)在 Diagram 界面里點擊"Run Block Automation"完成對 ZYNQ7 Processing System IP核的配置,生成外部 ZYNQ 系統的外部鏈接 IO 管腳。

e024a776-cd9e-11ec-bce3-dac502259ad0.png

(5)在 Source 窗口中選中 design_1.bd,右鍵并先后選擇Generate Output Projects 和 Create HDL Wrapper 選項,生成頂層文件design_1_wrapper。

(6)在頂層文件中例化我們原來的工程;(特別注意:要將原來工程的外部引腳也例化為現在頂層工程的I/O,并配置好約束)。

(7)重新生成bit流。

(8)Export to Hardware(包含bitstram 文件),Launch SDK,暫時告別VIVADO,進入SDK進行操作。

2.1 SDK操作

(1)進入SDK 開發環境后,點擊菜單 File -> New -> Application Project。

e05da774-cd9e-11ec-bce3-dac502259ad0.png

(2)點擊next,選擇Zynq FSBL

e071cbdc-cd9e-11ec-bce3-dac502259ad0.png

(3)接下去我們要把 FSBL 可執行文件,FPGA PL的bit比特流文件和PS應用程序結合成一個 Bin 文件或Mcs文件。

選擇菜單 Xilinx Tools->Create Boot Image:

e0874b74-cd9e-11ec-bce3-dac502259ad0.png

選擇output.bif的存放地址,選擇生成bin文件還是mcs文件,然后依次添加zynq_fsbl.elf(BootLoader)、bit文件、應用程序elf文件(這個如果沒有可以省略),最終生成用于固化的bin或者mcs文件。

e09af78c-cd9e-11ec-bce3-dac502259ad0.jpg

(4)將生成的bin或者mcs文件下載到Flash(經過驗證,這兩種類型的文件都可以

開發板上電,選擇菜單 Xilinx Tools->Program Flash:

e0ce526c-cd9e-11ec-bce3-dac502259ad0.png

加載文件:

e0e2f0d2-cd9e-11ec-bce3-dac502259ad0.png

(5)點擊Program,出現如下信息,則成功。然后斷電,切換板子的啟動方式,然后重新上電就會發現板子自動配置完成的燈亮了,搞定!

e0f66fd6-cd9e-11ec-bce3-dac502259ad0.png

注意:若出現以下信息,排除掉Jtag線纜的問題之后,可能的原因是之前同時連接過多個開發板,導致識別出來的芯片型號有不止一個,然后它就檢測到JTAG斷開(我就是這個問題)。

e10a64b4-cd9e-11ec-bce3-dac502259ad0.png

解決方法很簡單:關掉SDK,重新打開,重新Program Flash即可。

審核編輯 :李倩


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原文標題:二、生成BOOT.bin或者BOOT.mcs

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