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項目原理圖出現的驗證錯誤的含義

Altium ? 來源:Altium ? 作者:Altium ? 2022-06-10 10:52 ? 次閱讀

在使用Altium Designer的過程中

我們收到許多用戶的提問

Q&A系列將針對用戶關注度較高的問題

請Altium技術專家為大家答疑解惑

項目原理圖出現的驗證錯誤的含義

在驗證項目中的原理圖時,編譯器可以生成各種信息

在哪里可以找到完整的編譯錯誤列表信息?

驗證Validate項目時(老版本上叫做編譯Compile),會執行電氣規則檢查 (ERC)。此檢查將根據“Project ? Project Options”中“Error Reporting ”和“Connection Matrix”選項卡下指定的項目選項報告違規情況。下面鏈接描述了所有編譯違規項以及如何解決違規項的詳細信息。

Project Compiler Violations Reference:

https://www.altium.com/documentation/altium-designer/project-compiler-violations-reference-ad

打開上面鏈接,里面有如下圖所示的鏈接,可以根據自己的編譯違規項對照查找相應的解釋。

6a77e3d8-e7ea-11ec-ba43-dac502259ad0.png

6ab0eda4-e7ea-11ec-ba43-dac502259ad0.png

6b06a82a-e7ea-11ec-ba43-dac502259ad0.png

注意:

在Altium Designer 20.0之前的軟件版本中,必須手動編譯項目以構建統一數據模型。從AD20.0起,設計數據模型在每次用戶操作后是通過動態編譯進行更新-創建動態數據模型(DDM)。所涉及的項目不需要手動編譯,一切都是自動完成的。

驗證的過程是為整個項目生成有效網表不可獲取的一部分。在編譯期間,可以根據設計項目選項(Project Options…)中定義的規則(分別在 Error Reporting 和Connection Matrix選項卡上)驗證原理圖中的連通性。

審核編輯 :李倩

聲明:本文內容及配圖由入駐作者撰寫或者入駐合作網站授權轉載。文章觀點僅代表作者本人,不代表電子發燒友網立場。文章及其配圖僅供工程師學習之用,如有內容侵權或者其他違規問題,請聯系本站處理。 舉報投訴
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原文標題:【Q&A】項目原理圖出現的驗證錯誤的含義

文章出處:【微信號:AltiumChina,微信公眾號:Altium】歡迎添加關注!文章轉載請注明出處。

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