Verilog基礎知識
簡介介紹
對于Verilog描述初學者來說，最難的莫過于編寫測試代碼并判斷自己寫的是否正確。在這里我推薦一個HDL描述練習網站，這個網站上的練習題無需自己編寫測試代碼，寫好邏輯代碼之后上傳，即可判斷你的代碼邏輯是否正確。網站鏈接如下：
這個網站上面有很多練習習題，如下圖所示，有Verilog基礎知識，基礎電路練習題（包括常見的組合邏輯，時序邏輯），狀態機練習題等，大家可以自行去看：
雙邊沿采樣電路實例
下面以一道雙邊沿采樣電路練習題帶大家來看看這個網站的使用。
（1）首先在網站的最左邊導航欄找到這道題，并點擊。
（2）點擊之后發現網頁最上部分是這道題的描述。
（3） 這里還有這道題做法的提示，如果未展開，點擊Hint即可展開。
（4） 在這個里面可以看到輸入輸出端口已經定義好了，可以直接編輯你的邏輯代碼，再點擊submit即可。
我設計的雙邊沿采樣電路如下圖所示。
故輸入代碼如下：
（5） 點擊Submit后，在下方即可看到運行結果如下圖所示。你可以通過他所報的錯或者對比你的波形（Yours）與正確參考波形（Ref）來判斷邏輯描述的正確性。
審核編輯：彭靜
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原文標題：HDL練習網站推薦-雙邊沿采樣電路
文章出處：【微信號：zhuyandz，微信公眾號：FPGA之家】歡迎添加關注！文章轉載請注明出處。
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