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Vivado中的Elaborate是做什么的?

傅里葉的貓 ? 來源:傅里葉的貓 ? 作者:傅里葉的貓 ? 2022-10-24 10:05 ? 次閱讀

在Vivado的界面中,有個RTL ANALYSIS->Open Elaborated Design的選項,可能很多工程師都沒有使用過。因為大家基本都是從Run Synthesis開始的。

d943fc22-52b4-11ed-a3b6-dac502259ad0.png

elaborate可以翻譯為“詳盡解析”,就是將RTL源代碼翻譯轉換成對應的電路。

有同學會問,這不是Synthesis做的工作嗎?

我們可以來比較一下Elaborate和Synthesis后的Schematic就很直觀了:

Elaborated Design:

d9726bde-52b4-11ed-a3b6-dac502259ad0.png

image-20221023165430449

Synthesisd Design:

d9994100-52b4-11ed-a3b6-dac502259ad0.png

image-20221023165346017

可以看出,Elaborated Design里面的電路是單純的對RTL源代碼的解析,到了Synthesisd Design,則可以看到Xilinx的具體的庫單元,比如LUT3、FDRE等,都是在Xilinx FPGA中真實存在的。

其實在綜合的log文件,看到Elaborate的存在,綜合的第一步就是先進行Elaborate:

d9ba9a26-52b4-11ed-a3b6-dac502259ad0.png

審核編輯:湯梓紅

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原文標題:Vivado中的Elaborate是做什么的?

文章出處:【微信號:傅里葉的貓,微信公眾號:傅里葉的貓】歡迎添加關注!文章轉載請注明出處。

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