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詳細(xì)講解一下MaxViaStack DRC的規(guī)則

jf_tpHP8OJR ? 來(lái)源:集成電路設(shè)計(jì)及EDA教程 ? 2022-12-27 16:22 ? 次閱讀

介紹:

max via stack就是design rule對(duì)可以上下堆疊的via(多層via的cut有overlap)的數(shù)量有限制,不能超過(guò)要求,否則就會(huì)報(bào)MaxViaStack的DRC。

簡(jiǎn)單舉個(gè)例子:比如Tech LEF/tf文件要求是4,那么v1-v2-v3-v4-v5在同一位置overlap就會(huì)報(bào)DRC。

下面以tech LEF為例詳細(xì)講解一下。

LEF里面的約束:

PROPERTYDEFINITIONS

LIBRARY LEF58_MAXVIASTACK STRING

"MAXVIASTACK maxStack [NOSINGLE] [RANGE bottomLayer topLayer] ;" ;

END PROPERTYDEFINITIONS

詳細(xì)解釋?zhuān)?/strong>

8c577e1e-8317-11ed-bfe3-dac502259ad0.png

MAXSTACK指定的是single cut via允許連續(xù)堆疊的最大數(shù)目,如果超過(guò)它就是DRC違反(不考慮multi cut via);

RANGE指定的是檢查的最低和最高層,如果不做約束的話默認(rèn)檢查的所有繞線層;

NOSINGLE(可選項(xiàng)),前面的MAXSTACK指定的是single cut via允許連續(xù)堆疊的最大數(shù)目,是不考慮multi cut的,因此遇到multi cut via的話會(huì)認(rèn)為中間是斷開(kāi)的,而如果指定NOSINGLE的話則認(rèn)為multi cut via沒(méi)有打斷堆疊,還會(huì)算在內(nèi)。

舉例:

8cb74678-8317-11ed-bfe3-dac502259ad0.png

如上圖所示,a和b都是只有single via堆疊,a從m1-m5堆疊了4層via,超過(guò)了第一行MAXSTACK 3 RANGE m1 m6的約束,b的話只有m1-m3,堆疊了3層via,沒(méi)有超過(guò)要求,所以沒(méi)有DRC違反。

c, d, e都是有multi cut via的情況,c的話如果只看signle via的話沒(méi)有超過(guò)下面tech LEF第一行的要求,如果同時(shí)考慮multi cut via的話,那么M1-M6的via都是有堆疊的,堆疊了5層via,所以違反了第二行MAXSTACK NOSINGLE 3 RANGE m1 m6的要求,會(huì)報(bào)DRC違反。

后邊的d e也是類(lèi)似。

問(wèn)題的修復(fù):

知道上面的規(guī)則之后,要想解這類(lèi)問(wèn)題就非常簡(jiǎn)單了,只要隨便把中間或者某層via錯(cuò)開(kāi)一段距離,讓它們之間沒(méi)有overlap就可以了。注意檢查錯(cuò)開(kāi)之后堆疊的via的數(shù)量是否滿(mǎn)足要求。不要出現(xiàn)這種情況:比如DRC要求只允許堆疊3層,現(xiàn)在堆疊了v1-v5,你想修這個(gè)問(wèn)題結(jié)果你挪動(dòng)了v5,那么還是解不了這個(gè)DRC的。






審核編輯:劉清

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原文標(biāo)題:MaxViaStack DRC規(guī)則詳解

文章出處:【微信號(hào):集成電路設(shè)計(jì)及EDA教程,微信公眾號(hào):集成電路設(shè)計(jì)及EDA教程】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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