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I2C_CLK容性負載導致access失敗怎么解決

麥辣雞腿堡 ? 來源:沈土豪的書屋 ? 作者:沈土豪 ? 2023-02-01 17:49 ? 次閱讀

像這樣的事情幾乎每周都在發生,前天是MDX access fail,今天是I2C fail。

因為做的次數多了,就成了熟練工,想起我剛工作前幾周每隔幾天都要問公司的前輩,我這I2C怎么又不通了...今天通了,明天又不通了。

故障現象:I2C 接口訪問reg不通。

Part 02

DEBUG過程:

三板斧,直接量I2C/SDA對地IO阻值,clk 幾K、sda幾M,沒有太大異常,因為有上下拉電阻

然后直接量示波器波圖,很明顯它“羊”了。

放大看一下,這些上下脈沖,其實就是clk的正負邊沿

pYYBAGPaNXeAYzQ6AACPJb2xm5g828.png

Part 03

因為有先前

[debug04]GPIO對地短路問題

的經驗,波圖極其相似。

我們這次直接給出結論:

CLK信號 drive不動,看波圖疑似clock對地短路/存在較大容性負載。

PCB背后貼了大電容(巨大,uF級)。拆除電容,故障恢復,結題~

我們可以對比下2種case,短路/容性負載下的波圖差異:

大容性負載:

poYBAGPaNY-AGF7lAACuapB6Tlc162.png

短路:

poYBAGPaNZyAN8INAAFD1CXEX6c501.png

我做下猜測:

clk跳變沿,短路的脈沖更窄,容性負載應當脈沖更寬,誰更容易產生振鈴?打個問號


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