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Verilog端口連接規則

冬至子 ? 來源:行走的BUG永動機 ? 作者:行走的BUG永動機 ? 2023-05-26 16:42 ? 次閱讀

端口

端口是模塊與外界交互的接口,對外部環境而言,模塊內部是不可見的,對模塊的調用只能通過端口連接進行

端口基本語法約定如下:

端口必須被聲明

端口聲明不可重復

端口聲明既可在端口列表內也可在列表外

模塊間的數據只能通過端口進行

端口聲明

根據端口的方向,端口類型有3種:輸入(input)、輸出(output)和雙向端口(inout)

  • input 和 output 只能是wire
  • output 既可以是 wire 也可以是 reg
    • 需要保存數值時,用reg
    • 不需要保存數值時,用wire

reg類型是用于保存數值的,而輸入端只能反映與其相連的外部信號的變化,并不能保存這些信號的值

端口連接規則

1.jpg

對于inpuoutput我是這樣理解的,內部是reg外部就應該是wire

就比如input這一端,外部是reg,內部是wire,在這個一端,已經有一個reg類型可以用來保存數據,不需要用到兩個reg來保存數值

端口連接方式

端口連接的方式有兩種:按位置連接按名稱連接

  1. 按位置連接
    調用模塊的端口名必須與被調用模塊端口列表中的位置保持一致
    //調用模塊
    module name(……);
        //端口定義
        //端口描述
    
    
        /*a, b, c, d分別對用調用模塊
           中的in1, in2, sel, dout*/
        mux u1(a, b, c, d);
    
    endmodule
    
    
    //調用模塊
    module mux (in1, in2, sel, dout);
        //端口定義
        //端口描述
        //邏輯描述
    endmodule
    
  2. 按名稱連接
    格式為:
    模塊名 模塊實例化名 (.被調用模塊端口名(調用模塊端口名));
    其中,模塊實例化名 是自己隨意定的一個名字,方便記憶就好
    //調用模塊
    module name(……);
        //端口定義
        //端口描述
    
        //模塊調用,也叫實例化
        //對應方式和上一個相同
        mux u1(.in1(a), .in2(b), .sel(c), .dout(d));
    endmodule
    
    //被調用模塊
    module mux(in1, in2, sel, dout);
        //端口定義
        //端口描述
        //邏輯描述
    endmodule
    
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