DDR 驗證是任何 SoC 中最關(guān)鍵和最復(fù)雜的任務(wù)之一,因為它涉及位于 DUT 內(nèi)部的控制器和位于板載 DUT 外部的外部 DDR 存儲器。在這里,我們將討論 DDR VIP 模型的快速初始化。
根據(jù) JEDEC 標準 JESD79-4 第 3.3.1 節(jié),RESET_n需要至少維護 200us。在模擬時間中,此值很長。此外,如果用戶的測試平臺違反此時間,Memory VIP 會將其標記為UVM_ERROR并失敗模擬。即使此沖突被標記為錯誤,也不會影響 VIP 模型的行為。
有許多方法可以繞過此違規(guī)行為。在本博客中,我們將討論其中一種方式。
Synopsys Memory VIP 具有稱為快速初始化的初始化功能,也稱為按比例縮小初始化。此功能的目的是允許控制覆蓋初始化參數(shù)以加快初始化過程。新值(無論是默認設(shè)置還是由用戶自定義)都可以縮短初始化時間,而不會斷言任何檢查器沖突。此外,它不會影響模型的初始化行為。此功能僅適用于前門訪問 - 與后門訪問相比。我們將在后續(xù)的博客文章中討論內(nèi)存 VIP 訪問的類型。
有兩種方法可以縮小初始化參數(shù)。一個是使用默認值設(shè)置的,另一個是自定義設(shè)置的。
根據(jù)標準,以下是預(yù)期值:
min_cke_high_after_reset_deasserted_in_pu_and_res_init_time_ps = 500000000
min_reset_pulse_width_in_pu_ps = 200000000
使用默認方法,可以從配置對象的build_phase調(diào)用函數(shù)“set_scaled_initialization_timings()”。該函數(shù)調(diào)用會將計時參數(shù)縮小到下面分配的值,而不會觸發(fā)檢查器沖突:
min_cke_high_after_reset_deasserted_in_pu_and_res_init_time_ps = 500000
min_reset_pulse_width_in_pu_ps = 200000
要自定義值,用戶可以設(shè)置自己的自定義值,然后設(shè)置標志“scaled_timing_flag”。VIP 將配置為用戶提供的值。因此:
對于分立器件:
// cfg handle of the svt_ddr_configuration class // Pass the cfg to the DDR Discrete Device component by using // the config_db mechanism. cfg.timing_cfg.min_cke_high_after_reset_deasserted_in_pu_and_res_init_time_ps = 500000; cfg.timing_cfg.min_reset_pulse_width_in_pu_ps = 200000; cfg.timing_cfg. tPW_RESET_ps = 100000; cfg.timing_cfg.scaled_timing_flag = 1; |
對于內(nèi)存型號:
// dimm_cfg is handle of svt_ddr_dimm_configuration foreach(dimm_cfg.data_lane_cfg[i]) begin foreach(dimm_cfg.data_lane_cfg[i].rank_cfg[j]) begin dimm_cfg.data_lane_cfg[i].rank_cfg[j].timing_cfg.min_cke_high_after_reset_deasserted_in_pu_and_res_init_time_ps = 500000; dimm_cfg.data_lane_cfg[i].rank_cfg[j].timing_cfg.min_reset_pulse_width_in_pu_ps = 200000; dimm_cfg.data_lane_cfg[i].rank_cfg[j].timing_cfg.tPW_RESET_ps = 100000; dimm_cfg.data_lane_cfg[i].rank_cfg[j].timing_cfg.scaled_timing_flag = 1; end end |
審核編輯:郭婷
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