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淺析后仿波形處理

全棧芯片工程師 ? 來源:全棧芯片工程師 ? 2023-08-12 10:02 ? 次閱讀

我們知道,Verdi橫空出世,大大加速了數字設計驗證的debug的效率,verdi波形格式是fsdb,壓縮率高,逐步取代了VCD波形,但是有些芯片設計環節仍然需要VCD。比如功耗分析需要fsdb轉換成VCD,比如模擬仿真需要數字的VCD激勵波形。

5c867124-3850-11ee-9e74-dac502259ad0.jpg

VCD是不壓縮的文本格式,兼容性好,缺點是文件太大。后仿先寫出高壓縮比的FSDB文件,再轉成VCD。可指定轉換起止時間、結束時間。接下來介紹怎么轉。

1. 轉換全部信號

%fsdb2vcd verilog.fsdb -o output.vcd

2.轉換指定模塊內的信號(命令需要指定-s),并指定轉換時間,時間默認是ns,也可以帶單位s|ms|us|ns|ps|fs。-level 1是/system/i_cpu不包括子模塊的所有信號,如果想得到/system/i_cpu及其子模塊的所有信號,則需要-level 0

%fsdb2vcd verilog.fsdb -s /system/i_cpu -level 1 -bt 10 -et 100

3. 生成fsdb的summary,如下命令并沒轉換。

%fsdb2vcd verilog.fsdb -summary

除了Redhwak、Voltus看功耗外,使用PTPX工具也可以進行代碼級功耗評估。PTPX工具需要使用SAIF對翻轉率進行標定,以得到相對準確功耗。SAIF文件從仿真波形中提取時較為穩妥,并且具有接近實際工作場景的翻轉率。fsdb2saif提取波形文件中信號翻轉率

1.轉換FSDB為SAIF

%fsdb2saif verilog.fsdb -o verilog.fsdb.saif

2. 指定時間轉換FSDB為SAIF

%fsdb2saif verilog.fsdb -bt 10ps -et 1000ps -o verilog.fsdb.saif

3. 指定轉換范圍

%fsdb2saif rtl.fsdb -s "/system/i_cpu" -o rtl.fsdb.saif

通常,$fsdbDumpvars(0, top)可以dump全部波形。






審核編輯:劉清

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原文標題:【景芯SoC培訓】后仿波形處理

文章出處:【微信號:全棧芯片工程師,微信公眾號:全棧芯片工程師】歡迎添加關注!文章轉載請注明出處。

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