大家好,這里是程序員 杰克 。一名平平無奇的嵌入式軟件工程師。
FPGA相比MCU而言,在數據位操作上有很明顯的優勢。FPGA支持任意位拼接以及數據截取操作。本篇主要是總結和分享一些對數據位操作的實用語法技巧。內容不多,其中最最最重要的內容是數據的動態位截取操作。
下面正式進入本章推送的內容。
01 數據位操作技巧
數據移位(shift)
Verilog中的移位操作有兩種:邏輯移位操作(logical)、算數移位操作(arithmetic)。邏輯移位使用“<<”、和“>>”,而算術移位使用“<<<”、和“>>>”,描述以及代碼示例如下所示:
//本示例使用邏輯、算術右移為例:
//邏輯右移( >>), 初始值為4'b1000, 移位結果為4'b0010
module shift();
reg [3:0] value, rusult;
initial begin
value = 4'b1000;
result = (value > > 2);
end
endmodule
//算術右移( >> >), 初始值為4'b1000, 移位結果為4'b1110
module shift();
reg signed [3:0] value, rusult;
initial begin
value = 4'b1000;
result = (value > >> 2);
end
endmodule
數據位拼接(concatenations)
顧名思義,“數據位拼接”是由多個表達式產生的位拼接在一起的輸出結果。其使用大括號“{}”來表示,內部表達式之間使用逗號“,”隔開。
對于位拼接操作,不允許使用不確定大小的常量;位拼接中唯一可以使用的操作是復制(replication)。
數據位拼接操作示例如下:
//1. 簡單位拼接操作
reg [1:0] a;
reg [3:0] b;
reg [9:0] result = {2'b10, a, b[2:0], 3'd7};
//2. 復制拼接操作
reg [1:0] c;
reg [2:0] d;
reg [9:0] result;
result = {2{c, d}};//=={ {c[1:0], d[2:0]}, {c[1:0], d[2:0]} }
//3. 參數化代碼示例
parameter PARA = 32; //PARA = [1,32]
wire [31:0] e;
assign e = { {(32-PARA){1'b1}}, f[(PARA-1):0] };
數據位截取(bit select)
數據位截取(bit select)可以從線網( net )、寄存器( reg )、整數( integer )、時間( time )、參數( parameter )等類型進行任意位截取。IEEE中Verilog標準中對位截取的語法表達式如下:
vect[msb_expr : lsb_expr];
/*
其中msb_expr 是整形/常量表達式, lsb_expr 是常量表達式;
當msb_expr為常量表達式時,數據位截取則為靜態截取;
當msb_expr為整形表達式時,數據位截取則為動態截取;
*/
靜態截取示例代碼如下:
//從vect[31:0]截取低16位賦值給value[15:0]
module bit_select();
reg [31:0] vect;
reg [15:0] value;
initial begin
vect = 32'hAAAA_CCCC;
value = vect[23:8]; //value = 16'hAACC;
end
endmodule
IEEE標準Verilog中,對reg、integer、time變量/parameter參數動態截取語法如下所示:
//動態截取操作語法
reg [15:0] big_vect;
reg [0:15] little_vect;
big_vect [lsb_base_expr +: width_expr]
little_vect [msb_base_expr +: width_expr]
bit_vect [msb_base_expr -: width_expr]
little_vect [lsb_base_expr -: width_expr]
/*
width_expr為常量表達式, 在代碼運行時不能改變;
lsb/msb_base_expr為整形表達式, 作為從在運行時可以動態改變;
width_expr作為截取的位寬值, 而msb/lsb_base_expr為截取的起始地址;
“+”為地址向上遞增操作, “-”為地址向下遞增操作;
上面代碼功能是:
從msb/lsb_base_expr地址開始, 向上(+)/向下"-"截取width_expr位寬的數據;
*/
在上面的代碼中,width_expr為常量表達式,代碼運行時不能改變;lsb_base_expr/msb_base_expr 為整形表達式,在運行時可以改變;代碼示例:
reg [31:0] big_vect;
reg [0:31] little_vect;
reg [63:0] dword;
integer sel;
big_vect[0 +:8] //==big_vect[7 :0], 從第0位向上截取8bit的數據
big_vect[15-:8] //==big_vect[15:8], 從第15位向下截取8bit的數據
little_vect[0 +:8] //==little_vect[0: 7]
little_vect[15-:8] //==little_vect[8:15]
dword[8*sel +: 8] //從第(8*sel)位截取8位寬
總結說明:
在表達式vect[base_expr +:/-: width_expr]中,
width_expr為截取的固定位寬,是常量值;
base_expr為截取的 起始第bit位地址 ,可以 是整形變量值,動態變更 ;
05 文章總結
對于一名優秀的FPGA工程師而言,合理應用數據位操作是一項非常重要的能力。對于一些特定的使用場合,合理使用數據位操作可以很大地節約邏輯資源。
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