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易靈思RAM使用--Update3

XL FPGA技術交流 ? 來源:易靈思FPGA技術交流 ? 作者:易靈思FPGA技術交流 ? 2023-12-12 09:52 ? 次閱讀

易靈思RAM在使用時可以會遇到一些問題,這里把常用的問題總結下。

1、ram初始化文件路徑是工程路徑

在對ram進行初始化時需要指定文件路徑,這里要注意'/'的方向。

(1)如果文件放在工程目錄下,寫法如下:

.RAM_INIT_FILE("./ram_init_file.inithex" )

或者.RAM_INIT_FILE("ram_init_file.inithex" )

(2)如果在工程目錄下新建一個src文件。寫法如下:

.RAM_INIT_FILE("./src/ram_int_file.mem")

1da7cc22-9891-11ee-be60-92fbcf53809c.png

2、在RAM評估器中評估RAM資源

易靈思提供了RAM資源評估器,可以快速幫忙評估RAM資源的使用情況。以下為操作步驟:

(1)把路徑轉換Efinity路徑下的bin文件夾下。

(2)通過以下命令評估

1db18b72-9891-11ee-be60-92fbcf53809c.png

efx_map_ramest --family Trion --mode area --size 10240x16

但是如果直接運行該命令會提示錯誤。

1dcee320-9891-11ee-be60-92fbcf53809c.png

因為efinity的路徑沒有寫入系統(tǒng)路徑,用windows 命令行的時候,需要先運行bin文件夾下的setup.bat來設置環(huán)境,然后運行命令,注意不同模式下資源使用量不同。

1ddc6a54-9891-11ee-be60-92fbcf53809c.png

3、大塊ram的使用

如果RAM資源使用比較多時,可能會報出以下錯誤。

1df4b0fa-9891-11ee-be60-92fbcf53809c.png

解決方案

在工程目錄下放置以下文件 文件名:efx_map_settings.ini

并在文件中輸入下面語句:max-bit-blast-mem-size = 524300

4)RAM使用報錯

(1)ERROR: RCLK port of EFX_RAM_5K instance u_ddr_rx_buffer/u_wr_fifo/FifoBuff__D$12 is constant

ERROR: EFX_RAM_5K instance u_ddr_rx_buffer/u_wr_fifo/FifoBuff__D$12 WCLK port is disabled, but WCLKE is not

ERROR: EFX_RAM_5K instance u_ddr_rx_buffer/u_wr_fifo/FifoBuff__D$12 WCLK port is disabled, but WE is not

ERROR: WDATA[0] port of EFX_RAM_5K instance u_ddr_rx_buffer/u_wr_fifo/FifoBuff__D$12 is not disabled in a disabled mode

ERROR: RCLK port of EFX_RAM_5K instance u_ddr_rx_buffer/u_wr_fifo/FifoBuff__D$2 is constant

ERROR: EFX_RAM_5K instance u_ddr_rx_buffer/u_wr_fifo/FifoBuff__D$2 WCLK port is disabled, but WE is not

ERROR: WDATA[0] port of EFX_RAM_5K instance u_ddr_rx_buffer/u_wr_fifo/FifoBuff__D$2 is not disabled in a disabled mode

錯誤原因:FIFO的時鐘給的是無效的。

5、如果要把小于256bit的ram綜合成register,可以在工程目錄下新建一個efx_map_settings.ini文件。并在文件中輸入以下兩句:

use-logic-for-small-mem=256use-logic-for-small-rom=256

1e0a3cae-9891-11ee-be60-92fbcf53809c.png

6、RAM綜合的其它操作請參考efinity-synthesis.pdf

這里包括對使能,復位等的寫法的注意事項。

審核編輯 黃宇

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