許多需要多個電源的半導(dǎo)體器件(例如 SoC 和 FPGA)都要求遵循電源時序。

本期我們將介紹一個不使用專用IC來配置電源時序的電路示例。

5V輸入多通道POL解決方案

向SoC/FPGA提供POL多電源

【課題】

高速瞬態(tài)響應(yīng) / 穩(wěn)定動作及減少CL

小型 / 高效率 / 散熱 / 低EMI

啟動 / 停止程序

凍結(jié)的對策

(1) SoC/FPGA用降壓DC/DC (POL電源)

作為POL電源，配置了高速瞬態(tài)響應(yīng)HiSAT-COT控制的DC/DC。

線圈一體型“micro DC/DC”實現(xiàn)了小型化/低EMI。

(XCL239/XCL240、XCL237/XCL238)

(2) 啟動/停止的電源程序

用復(fù)位IC XC6119C及向各個DC/DC的EN的RC延遲，實現(xiàn)啟動/停止的電源程序。

停止時使用 CL放電功能。

● 各個DC/DC達到ON/OFF為止的延遲時間：

tdelay(ON) = R x C x ( -ln(( VIN – VEN) / VIN ))

tdelay(OFF) = R x C x ( -ln( VEN / VIN ))

※ VEN: EN的閾值電壓

● 考慮各個DC/DC的軟啟動和CL放電帶來的放電時間，調(diào)整RC定數(shù)。

(3) 通過用看門狗定時器凍結(jié)的對策: XC6130/XC6131

與3.3V線電壓監(jiān)控電壓的同時，凍結(jié)時通過WD功能檢測。

發(fā)生異常時自動地再啟動SoC/FPGA。

還備有手動復(fù)位功能。(XC6130)

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