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全數字鎖相環 (ADPLL)設計

oCEM_ICPlatform ? 來源:未知 ? 作者:胡薇 ? 2018-07-10 16:06 ? 次閱讀

6月12日,由工業信息化部人才交流中心主辦,IC智慧谷、上海林恩信息咨詢有限公司承辦,南京江北新區人力資源服務產業園、中國半導體行業協會集成電路分會、上海集成電路技術與產業促進中心協辦的第65期國際名家講堂在上海舉辦,來自加利福尼亞大學洛杉磯分校(UCLA)的著名教授Behzad Razavi為中國的學員們帶來了高性能鎖相環設計短期高級課程。

PLL電路是用于生成與輸入信號相位同步的新的信號電路,無論是工業還是民用,PLL電路的應用范圍非常廣,教授首先介紹了PLL的基本結構與各部分工作原理,對鑒相器和壓控振蕩器的設計都做了大致的說明,在穩定性、紋波和相位偏移之間的設計折衷給出了自己的建議。PLL電路的特性由環路濾波器決定,因此設計PLL電路時,將其深刻理解為負反饋電路非常重要,穩定的PLL電路的環路濾波器的設計方法是PLL設計的精髓。

隨后教授連續講解了4篇ISSCC發布的最新成果,傳遞最新的設計技術,包括PLL中各模塊的濾波、疊加等相位噪聲抑制技術,FinFET技術節點上的版圖設計問題,更小的隨機抖動設計方法,以及5G應用中低于-50dBm的功率設計技術和低于-40dBc的噪聲設計技術。學員們都在電路實例中收獲了應對PLL非理想效應的實際設計經驗。

課程的最后一個專題環形振蕩器的相位噪聲分析,影響相位噪聲的因素具有不同的性質,然而很難找到一種通用的方法來包含各種影響因素以獲得PLL系統的總相位噪聲,教授在噪聲分析方面也提出了兩個基本的設計準則,并介紹了一種沒有電感元件的低噪聲PLL設計技術。

聲明:本文內容及配圖由入駐作者撰寫或者入駐合作網站授權轉載。文章觀點僅代表作者本人,不代表電子發燒友網立場。文章及其配圖僅供工程師學習之用,如有內容侵權或者其他違規問題,請聯系本站處理。 舉報投訴
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原文標題:【精彩回顧】第65期國際名家講堂:高性能鎖相環設計

文章出處:【微信號:ICPlatform,微信公眾號:芯動力人才計劃】歡迎添加關注!文章轉載請注明出處。

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