1 引 言

MPEG-4視頻壓縮標準自問世以來受到人們的廣泛關注。近幾年，嵌入式應用中對MPEG-4播放器的實現已經成為眾多廠家的研究熱點。視頻壓縮的重要性以及其標準的發(fā)展歷程。隨著數字化、網絡化全球一體化信息時代的來臨，包括聲音、圖形、數據以及圖像、影像在內的多媒體信息的維送和處理；其關鍵在于后編技術。由于MPEG-4系統龐大且需要大量的數據處理，因此在ARM中實現MPEG-4軟解碼需要對其原算法進行充分的優(yōu)化才能達到理想的性能。為此研究了一種基于ARM926EJ-S微處理器的MPEG-4解碼算法的純軟件實現和優(yōu)化的方法，通過對解碼算法的軟件優(yōu)化，將QVGA格式MPEG-4碼流在ARM9平臺上的播放速度由原來的10 f/s提高到了37 f/s，完全達到了流暢播放的要求，具有很高的實用價值。目前，視頻技術的應用范圍很廣，如網上可視會議、網上可視電子商務、網上政務、網上購物、網上學校、遠程醫(yī)療、網上研討會、網上展示廳、個人網上聊天、可視咨詢等業(yè)務。

2開發(fā)平臺及耗時分析

論文研究使用的是基于ARM926EJ-S微處理器的綜合開發(fā)平臺，采用Linux操作系統，Linux是一類Unix計算機操作系統的統稱。Linux操作系統的內核的名字也是“Linux”.Linux操作系統也是自由軟件和開放源代碼發(fā)展中最著名的例子。嚴格來講，Linux這個詞本身只表示Linux內核，但在實際上人們已經習慣了用Linux來形容整個基于Linux內核，并且使用GNU 工程各種工具和數據庫的操作系統。Linux得名于計算機業(yè)余愛好者Linus Torvalds.外接320*240（QVGA格式）的LCD顯示屏。ARM926EJ-S微處理器的時鐘頻率為190 MHz;采用5級整數流水線操作，支持32位ARM指令集和16位Thumb指令集以及擴充的DSP指令集；支持數據Cache和指令Cache，具有更高的指令和數據處理能力。

MPEG-4 SP級算法流程圖如圖1所示。優(yōu)化的前期工作首先要將MPEG-4解碼代碼移植到開發(fā)平臺上，然后對解碼各個模塊進行運算量和耗時分析，找出優(yōu)化的重點內容。本文采用長度為376 934 B的AVI碼流為測試序列，該碼流共95幀，其中包括8個I幀，87個P幀。在未優(yōu)化前測得的耗時分析結果如表1所示，整個測試序列解碼播放完畢耗時10.05 s，解碼播放速度只有9.5 f/s.

ARM（Advanced RISC Machines）是微處理器行業(yè)的一家知名企業(yè)，設計了大量高性能、廉價、耗能低的RISC處理器、相關技術及軟件。技術具有性能高、成本低和能耗省的特點。適用于多種領域，比如嵌入控制、消費/教育類多媒體、DSP和移動式應用等。在ARM上用軟件實現MPEG-4解碼器的主要任務是提高解碼速度，同時達到理想的畫面播放效果。

3 MPEG-4解碼算法在ARM926EJ-S上的優(yōu)化

MPEG-4軟解碼以開源的XVID源代碼做為參考，將XVID的C源代碼移植到ARM平臺上，在此基礎上進行優(yōu)化并測試優(yōu)化后的解碼播放性能。優(yōu)化主要從3個方面進行：

（1）對XVID源代碼的軟件結構，程序流程進行適合ARM特點的調整。

（2）對運算量較大、耗時較多的模塊編寫匯編函數代替C程序模塊，提高程序執(zhí)行效率。

（3）尋找快速或并行算法。

3.1軟件結構的優(yōu)化

ARM的資源非常有限，在軟件的結構安排上應盡量減少存儲器訪問，增加Cache的命中率，提高程序執(zhí)行效率。

3.1.1 適當的模塊合并處理以減少存儲器的訪問次數

優(yōu)化前的源代碼中，I幀與P幀的宏塊解碼軟件結構如圖2所示。在這個流程中，對于inter宏塊，可變長解碼（VLD），反掃描（Iscan），反量化（Iquant）三個過程中有3次的Block存儲區(qū)讀，2次Block存儲區(qū)寫和1次Data存儲區(qū)寫。源代碼是指未編譯的按照一定的程序設計語言規(guī)范書寫的文本文件。 源代碼（也稱源程序），是指一系列人類可讀的計算機語言指令。 在現代程序語言中，源代碼可以是以書籍或者磁帶的形式出現，但最為常用的格式是文本文件，這種典型格式的目的是為了編譯出計算機程序。計算機源代碼的最終目的是將人類可讀的文本翻譯成為計算機可以執(zhí)行的二進制指令，這種過程叫做編譯，通過編譯器完成。

合并后VLD從Block緩沖區(qū)讀數據處理后馬上進行反掃描和反量化，并將反量化后的數據存入Block中。整個過程只進行了一次Block緩沖區(qū)的讀和寫，不僅減少了兩個讀寫操作，還減少了一個Data緩沖區(qū)的開辟。同時，對于P幀在VLD之后立即進行反量化還省去了大量零值的處理，這也是考慮合并的主要因素之一。

同樣，I幀中的AC/DC預測和反量化也可以進行合并。做法是：將add_acdc（pMB，i，&block［i*64］，iDcScaler，predictors）；dequant_intra（&data［i*64］，&block［i*64］，iQuant，iDcScaler）兩個函數合并為：add_acde（pMB，i，&block［i*64］，iDcSealer，predictors，cbpcontrol，iQuant）。這個過程在減少存儲器的讀寫操作的同時也減少了沒有預測的AC值的反量化過程。

通過以上兩個步驟的合并處理，由測試序列測試之后發(fā)現解碼播放完畢耗時5.23 s，速度提高了將近9 f/s，效果非常明顯。

3.1.2 調整子塊處理以增加Cache命中率

MPEG-4每個宏塊由6個子塊組成。在XVID源代碼中，宏塊解碼中的6個子塊的所有處理一起進行，被放在一個大的for循環(huán)中。ARM9采用哈佛結構，分別擁有I-cache和D-cache，所有處理同時進行，某一子塊的值會一直在D-cache中不被替換，對于D-cache是非常有利的，但是對于I-cache來說卻會造成代碼的不斷替換而影響Cache效率。高速緩沖存儲器（Cache）其原始意義是指存取速度比一般隨機存取記憶體（RAM）來得快的一種RAM，一般而言它不像系統主記憶體那樣使用DRAM技術，而使用昂貴但較快速的SRAM技術，也有快取記憶體的名稱。對于I幀，由于其數據量比較大，數據替換的開銷會遠遠大于代碼替換。具體的做法是：

這個過程使解碼速度提高了將近4 f/s.

另外對于I幀，IDCT與VOP重建也是可以合并的，這個過程可以減少存儲器的訪問次數。但是這個合并過程不符合ARM的Cache工作特性，因此優(yōu)化的效果并不明顯，這也是優(yōu)化過程中矛盾折衷的明顯體現。

3.2 編寫ARM匯編函數

ADS編譯器對C程序有很強的編譯能力，但對于一些運算量較大，涉及存儲器訪問較多的模塊，仍然需要使用ARM匯編優(yōu)化。這部分主要是針對耗時較多的IDCT，插值，VOP重建等模塊。在書寫匯編函數時，要充分把握ARM處理器的特性，ARM處理器特點1、體積小、低功耗、低成本、高性能；2、支持Thumb（16位）/ARM（32位）雙指令集，能很好的兼容8位/16位器件；3、大量使用寄存器，指令執(zhí)行速度更快；4、大多數數據操作都在寄存器中完成；5、尋址方式靈活簡單，執(zhí)行效率高；6、指令長度固定。盡量避開多周期指令，避免流水線阻塞，合理分配寄存器以盡量減少存儲器操作。匯編函數的優(yōu)化包括以下幾點：

3.2.1避免多周期指令

在ARM匯編中，相對耗時的指令主要有存儲器操作指令load/stor，程序跳轉指令B，乘法指令MUL等。在編寫匯編函數時，要盡量的考慮這些指令的替換方案。

對于存儲器操作指令，可以采用多寄存器傳送指令LDM/STM來替換。一次LDR指令需要5個指令周期，而N個寄存器傳送的LDM指令只需要N+4個指令周期。IDCT、插值、VOP重建中的數據讀取都是連續(xù)地址操作，可以一次讀人4個甚至更多的數據到寄存器以減少程序的執(zhí)行指令周期數。

其次，一條程序跳轉指令B需要3個指令周期，利用手寫匯編可以避免ADS編譯C時經常出現的函數跳轉指令，同樣減少了執(zhí)行周期數。

3.2.2避免流水線阻塞

ARM9采用五級流水線，執(zhí)行效率很高，但是如果指令設置不當，很容易造成流水線阻塞而影響執(zhí)行效率。解決流水線互鎖的辦法主要是預裝載和循環(huán)展開。

預裝載，即將接下來要用到的數據在不影響寄存器使用的情況下提前兩個以上指令周期裝載到寄存器中。這。

循環(huán)展開，即將循環(huán)體內的主體多次循環(huán)將循環(huán)跳轉次數減少。這樣不僅可以減少B跳轉指令帶來的流水線刷新，同時可以在前一個循環(huán)中通過預裝載下一個循環(huán)需要用的數據來避免流水線的互鎖。

3.2.3盡量減少存儲器操作

將經常使用的數據保持在寄存器中，避免每次用數據時都從存儲器讀取。尤其在IDCT中，盡量將一行或一列的數據一直保持在寄存器中，寄存器的執(zhí)行效率是最高的，合理的分配寄存器和利用堆棧可以使程序更優(yōu)。

一個高效的匯編程序可以使整個性能有較多的改善，通過ARM匯編函數的替換，測試序列解碼播放完畢耗時3.1 s，解碼速度提高了8 f/s.

3.3尋找快速算法和并行算法

ARM匯編的好處不僅在于執(zhí)行效率高，還在于可以充分利用ARM處理32位數據的特性，尋找快速算法和并行算法。

對于插值函數，可以采用并行算法來一次處理多個象素。每個象素是一個8位數據，而ARM處理器是32位，因此可以改進算法一次處理4個象素。插值中的關鍵算法是：

rounding是碼流中一個取0或1的參數。我們可以改進這個算法4個象素一起處理。通過分析知道，可以將式（1）改為A/2+B/2+C，C也應該是一個取0或者取1的值。分析的結果發(fā)現，當rounding為0時，C=（A∣B）&0X01;當rounding為1時，C=（A&B）&0X01.此時我們可以用4個象素組成兩個32位的字W1，W2，利用公式：

或

W的結果等同于四個象素單獨處理的結果。但是由于ARM處理器字讀取時是字地址對齊的，因此要注意改進算法引起的字地址不對齊問題，利用這個算法時可以通過拼字的方法來解決字地址對齊的問題。

通過這一步驟的優(yōu)化，測試序列解碼播放完畢耗時2.56 s，解碼速度提高了6 f/s，整體解碼速度達到了37 f/s.

4結語

本文對MPEG-4軟解碼器在ARM平臺上的實現及優(yōu)化的整體思路和步驟進行了闡述，優(yōu)化結果理想，軟解碼播放速度由最初移植完畢時的10 f/s提高到了37 f/s.本文給出的優(yōu)化方案可以進一步推廣到H.264或者其他視頻軟解碼系統基于ARM的應用中。全球的視訊業(yè)務需求猛增。現有的視訊業(yè)務應用主要以政府部門會議為主，在遠程教育、遠程醫(yī)療以及商用方面的應用很少，而國外90%的企業(yè)都在使用視訊業(yè)務，已是“信息高速公路”的主體通信業(yè)務，因此市場潛力巨大。在視訊業(yè)務中使用的視頻壓縮標準作為關鍵技術，其發(fā)展和應用也將是巨大的。