賽靈思“Vivado 專家系列”研討會將由來自賽靈思 Vivado 開發者及資深技術支持團隊成員為您帶來包括技術分享、設計方法學、設計技巧等內容，以幫助用戶快速提高其基于 FPGA 的設計效率。此次研討會為該系列的第一期，旨在深入剖析 Vivado 高速時序收斂技術。另外我們還將總結高速設計面臨的挑戰，介紹設計分析、設計向導以及設計復雜性和擁塞的分析方法。
演 講 嘉 賓
高亞軍（Lauren Gao）
賽靈思戰略應用高級工程師
專注于 C/C++ 高層次綜合，擁有多年利用 Xilinx FPGA 實現數字信號處理算法的經驗，對 Xilinx FPGA 的架構、開發工具和設計理念有深入的理解。發布《Vivado入門與提高》，《Vivado HLS 快速上手》等網絡視頻課程，點擊率超過10萬、出版《基于FPGA的數字信號處理（第2版）》及《Vovadp從此開始》等書籍，廣受好評。
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