克服空翻→邊沿觸發方式和主從觸發方式
4.3 邊沿觸發器
4.3.1 TTL邊沿JK觸發器
一、電路結構
二、邏輯功能
三、具有直接置0和置1端的邊沿JK觸發器
四、JK觸發器構成的T觸發器和T′觸發器
1．JK觸發器→T觸發器
2．JK觸發器→T′觸發器
4.3.2 維持阻塞D觸發器
一、電路結構
二、邏輯功能
三、具有直接置0和置1端的維持阻塞D觸發器
四、D觸發器構成的T觸發器和T′觸發器
1．D觸發器→T觸發器
2．D觸發器→T′觸發器
4.4 主從觸發器
4.4.1 主從RS觸發器
一、電路結構
二、邏輯功能
4.4.2 主從JK觸發器
一、電路結構
二、邏輯功能
總結：
觸發器的邏輯功能
觸發器的觸發方式
現代教學方法與手段：用DLCCAI或EWB演示各種MSI觸發器的邏輯功能。
用數字邏輯實驗箱演示各種集成觸發器的邏輯功能和觸發方式。
集成觸發器中常見的直接置0和置1端

4.3 邊沿觸發器
為何要用邊沿觸發器？
同步觸發方式存在空翻，為了克服空翻。
邊沿觸發器只在時鐘脈沖CP上升沿或下降沿時刻接收輸入信號，電路狀態才發生翻轉，從而提高了觸發器工作的可靠性和抗干擾能力，它沒有空翻現象。
邊沿觸發器主要有維持阻塞D觸發器、邊沿JK觸發器、CMOS邊沿觸發器等。
以下各邊沿觸發器的具體電路不詳細分析其工作原理，只簡單了解即可。因為集成觸發器的學習以應用時夠用為度，不強調內部電路。
4.3.1 TTL邊沿JK觸發器

一、電路結構

邏輯符號中“ ”表示邊沿觸發輸入。
加小圓圈：表示下降沿有效觸發
不加小圓圈：表示上升沿有效觸發

二、邏輯功能

四、JK觸發器構成的T觸發器和T′觸發器
T觸發器：具有保持和翻轉功能的觸發器。
T′觸發器：只具有翻轉功能的觸發器。

1．JK觸發器→T觸發器
令JK觸發器的J=K=T
T觸發器特性方程

4.3.2 維持阻塞D觸發器

一、電路結構

二、邏輯功能與觸發方式

㈠ 邏輯功能

1．設輸入D＝1

⑴ 在CP＝0時，保持。
因D＝1，G6輸入全1，輸出Q6＝0，它使Q4＝1、Q5＝1。
⑵ 當CP由0躍變到1時，觸發器置1。
在CP＝1期間，②線阻塞了置0通路，故稱②線為置0阻塞線。
③線維持了觸發器的1狀態，故稱③線為置1維持線。

2．設輸入D＝0

⑴ 在CP＝0時，保持。
因D＝0，G6輸出Q6＝1，這時，G5輸入全1，輸出Q5＝0。
⑵ 當CP由0正躍到1時，觸發器置0。
在CP＝1期間，①線維持了觸發器的0狀態，故稱①線為置0維持線。
④線阻塞了置1通路，故稱④線為置1阻塞線。

可見，它的邏輯功能和前面討論的同步D觸發器的相同。因此，它們的特性表、驅動表和特性方程也相同。

㈡ 觸發方式——邊沿式

維持阻塞D觸發器是用時鐘脈沖上升沿觸發的。因此，又稱它為邊沿D觸發器。

三、具有直接置0和置1端的維持阻塞D觸發器

圖4.3.5（a）所示為上升沿觸發的維持阻塞D觸發器CT7474的邏輯圖。

四、D觸發器構成的T觸發器和T′觸發器

4.4 主從觸發器
1．主從觸發器與邊沿觸發器同樣可以克服空翻。
2．結構：主從結構。內部有相對稱的主觸發器和從觸發器。
3．觸發方式：主從式。主、從兩個觸發器分別工作在CP兩個不同的時區內。
總體效果上與邊沿觸發方式相同。
狀態更新的時刻只發生在CP信號的上升沿或下降沿。
4．優點：在CP的每個周期內觸發器的狀態只可能變化一次，能提高觸發器的工作可靠性。
主從觸發器是在同步RS觸發器的基礎上發展出來的。

各種邏輯功能的觸發器都有主從觸發方式的，即：
主從RS觸發器、主從JK觸發器、主從D觸發器、
主從T觸發器、主從T′觸發器。

4.4.1 主從RS觸發器
一、電路結構

由兩個同步RS觸發器串聯組成的，上面的為從觸發器、下面的為主觸發器。
G門的作用是將CP反相為 ，使主、從兩個觸發器分別工作在兩個不同的時區內。

二、邏輯功能

1．當CP＝1時， ＝0，
從觸發器被封鎖，保持原狀態不變。
主觸發器工作，接收R、S信號，主觸發器的狀態按RS邏輯功能更新。
2．當CP由1↓0時，即CP＝0、＝1。
主觸發器被封鎖，不受R、S端輸入信號的控制，且保持原狀態不變。
從觸發器跟隨主觸發器的狀態翻轉。

4.4.2 主從JK觸發器

一、電路結構

邏輯符號中“┐”：表示主從觸發輸出。

二、邏輯功能

（CP下降沿到來有效）（4.4.4）

總結：觸發器的兩要素：
㈠ 邏輯功能
1．描述方法：邏輯符號、特性表、驅動表、特性方程

⑴ 邏輯符號
圖中“ ”表示邊沿觸發輸入。
加小圓圈：表示下降沿有效觸發
不加小圓圈：表示上升沿有效觸發
圖中“┐”表示主從觸發輸出。

⑵ 特性表

㈡ 觸發方式

1．基本RS觸發器
直接電平觸發（低電平有效/高電平有效），無CP
2．同步觸發
CP的（高/低）電平期間觸發，
即在整個電平期間接收信號RS/JK/D/T、
在整個電平期間狀態相應更新。
所以存在空翻。
3．邊沿觸發
只在CP的↑或↓邊沿觸發
即只在CP的↑或↓邊沿接收信號RS/JK/D/T、
只在CP的↑或↓邊沿狀態更新。
克服空翻。
4．主從觸發
有主、從兩個觸發器，在CP的高/低電平期間交替工作、封鎖。
只在CP的高電平期間（或低電平期間）接收信號RS/JK/D/T、
只在CP的↑或↓邊沿總的輸出狀態更新。

用數字邏輯實驗箱演示各種集成觸發器的邏輯功能和觸發方式。

現代教學方法與手段：用DLCCAI或EWB演示各種MSI觸發器的邏輯功能。

集成觸發器中常見的直接置0和置1端
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非號：低電平有效，
直接（異步）：不受CP的影響。