Verilog HDL 數(shù)字系統(tǒng)設(shè)計(jì)
2012-08-17 21:10:51
Verilog HDL代碼書(shū)寫(xiě)規(guī)范
2017-09-30 08:55:28
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 174 Verilog HDL 基本語(yǔ)法
2017-12-08 14:39:50
本帖最后由 IC那些事兒 于 2020-11-30 19:05 編輯
Verilog HDL是一種硬件描述語(yǔ)言，用于從算法級(jí)、門(mén)級(jí)到開(kāi)關(guān)級(jí)的多種抽象設(shè)計(jì)層次的數(shù)字系統(tǒng)建模。被建模的數(shù)字系統(tǒng)對(duì)象
2020-11-30 19:03:38
Verilog HDL學(xué)習(xí)資料
2012-08-01 14:53:28
Verilog HDL教程，供大家參考。
2013-07-18 17:11:36
Verilog HDL的歷史及設(shè)計(jì)流程是什么
2021-05-06 08:52:01
Verilog HDL是一種用于數(shù)字邏輯電路設(shè)計(jì)的語(yǔ)言。用Verilog HDL描述的電路設(shè)計(jì)就是該電路的Verilog HDL模型。Verilog HDL既是一種行為描述的語(yǔ)言也是一種結(jié)構(gòu)描述
2019-09-06 09:14:16
Verilog HDL的基本語(yǔ)法 .pdf
2012-08-15 15:06:11
Verilog HDL程序設(shè)計(jì)與實(shí)踐(xilinx)!Verilog HDL程序設(shè)計(jì)與實(shí)踐(xilinx)!
2014-11-21 16:15:00
本帖最后由 莉兒 于 2013-10-5 20:06 編輯
Verilog HDL設(shè)計(jì)的要點(diǎn).pdf
2013-10-05 20:05:08
本合集資料包括：1.Verilog HDL程序設(shè)計(jì)實(shí)例詳解2.Verilog HDL經(jīng)典教程3.Verilog HDL實(shí)驗(yàn)練習(xí)與語(yǔ)法手冊(cè)4.Verilog HDL硬件描述語(yǔ)言
2020-08-21 10:06:20
Verilog HDL語(yǔ)法，要的拿
2016-01-24 22:53:48
嵌入式開(kāi)發(fā)Verilog教程（二）——Verilog HDL設(shè)計(jì)方法概述前言一、Verilog HDL語(yǔ)言簡(jiǎn)介1.1 Verilog HDL語(yǔ)言是什么1.2前言在數(shù)字邏輯設(shè)計(jì)領(lǐng)域，迫切需要一種共同
2021-11-08 09:30:31
Verilog HDL語(yǔ)言有什么優(yōu)越性Verilog HDL語(yǔ)言在FPGA/CPLD開(kāi)發(fā)中的應(yīng)用
2021-04-23 07:02:03
誰(shuí)能用簡(jiǎn)潔易懂的語(yǔ)言告訴我，Verilog hdl密勒解碼器的原理，目的等等
2014-11-04 17:55:16
verilog HDL語(yǔ)法總結(jié)
2020-03-16 14:26:27
誰(shuí)曉得有verilog hdl視頻教程適合初學(xué)者的詳細(xì)的。。。。。。。。。。
2012-03-12 16:23:07
誰(shuí)有verilog hdl詳細(xì)視頻教程適合初學(xué)者。。 小弟求地址！！！
2012-03-12 16:26:17
VHDL 和verilog HDL講解
2013-10-09 20:32:00
verilog hdl教程
2014-04-22 16:10:18
《Verilog HDL 程序設(shè)計(jì)教程》
2012-08-10 17:53:28
Verilog HDL 的特點(diǎn)Verilog HDL 語(yǔ)言不僅定義了語(yǔ)法，而且對(duì)每個(gè)語(yǔ)法結(jié)構(gòu)都定義了清晰的模擬、仿真語(yǔ)義。使用這種語(yǔ)言編寫(xiě)的模型可以方便地使用 Verilog 仿真器進(jìn)行驗(yàn)證
2018-09-18 09:33:31
基于Verilog HDL的DDS設(shè)計(jì)與仿真
2012-08-19 23:15:05
什么是數(shù)字系統(tǒng)？verilog hdl又是什么？基于verilog hdl的數(shù)字系統(tǒng)應(yīng)用該如何去設(shè)計(jì)？
2021-06-21 06:54:02
CAM具有什么功能？基于移位寄存器的CAM的設(shè)計(jì)基于移位寄存器的CAM的Verilog HDL實(shí)現(xiàn)
2021-04-13 06:28:23
數(shù)字系統(tǒng)設(shè)計(jì)：Verilog HDL實(shí)現(xiàn)
2015-07-16 16:19:59
Verilog HDL Synthesis (A Practical Primer)
2009-02-12 09:36:24
40 Verilog HDL 綜合實(shí)用教程第1章 基礎(chǔ)知識(shí)第2章 從Verilog結(jié)構(gòu)到邏輯門(mén)第3章 建模示例第4章 模型的優(yōu)化第5章 驗(yàn)證附錄A 可綜合的語(yǔ)言結(jié)構(gòu)附錄B 通用庫(kù)
2009-07-20 11:21:1386 采用 Verilog HDL 語(yǔ)言在Altera 公司的FPGA 芯片上實(shí)現(xiàn)了RISC_CPU 的關(guān)鍵部件狀態(tài)控制器的設(shè)計(jì),以及在與其它各種數(shù)字邏輯設(shè)計(jì)方法的比較下,顯示出使用Verilog HDL語(yǔ)言的優(yōu)越性.關(guān)鍵詞
2009-08-21 10:50:0569 Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)本書(shū)從實(shí)用的角度介紹了硬件描述語(yǔ)言Verilog-HDL。通過(guò)動(dòng)手實(shí)踐,體驗(yàn)Verilog-HDL的語(yǔ)法結(jié)構(gòu)、功能等內(nèi)涵。在前五章,以簡(jiǎn)單的實(shí)例列舉了Verilog-HDL的用法;
2009-11-14 22:57:40146 Verilog hdl教程實(shí)例
【例 3.2】4 位計(jì)數(shù)器module count4(out,reset,clk);output[3:0] out;input reset,clk;reg
2010-02-09 09:41:0154 Verilog HDL 華為入門(mén)教程
本文主要介紹了Verilog HDL 語(yǔ)言的一些基本知識(shí)，目的是使初學(xué)者能夠迅速掌握HDL設(shè)計(jì)方法，初步了解并掌握Verilog HDL語(yǔ)言的基本要素，能
2010-02-11 08:35:38140 Verilog HDL入門(mén)教程(華為絕密資料)
本文主要介紹了Verilog HDL 語(yǔ)言的一些基本知識(shí)，目的是使初學(xué)者能夠迅速掌握HDL設(shè)計(jì)方法，初步了解并掌握Verilog HDL語(yǔ)言的
2010-04-02 11:52:210 Verilog HDL練習(xí)題
2010-11-03 16:47:13193 摘 要：通過(guò)設(shè)計(jì)實(shí)例詳細(xì)介紹了用Verilog HDL語(yǔ)言開(kāi)發(fā)FPGA/CPLD的方法，并通過(guò)與其他各種輸入方式的比較，顯示出使用Verilog HDL語(yǔ)言的優(yōu)越性。
2009-06-20 11:51:28
1857 
Verilog HDL程序基本結(jié)構(gòu)與程序入門(mén)
Verilog HDL程序基本結(jié)構(gòu)
Verilog HDL是一種用于數(shù)字邏輯電路設(shè)計(jì)的語(yǔ)言。用Verilog HDL描述的
2010-02-08 11:43:302185 Verilog HDL語(yǔ)言簡(jiǎn)介
1．什么是Verilog HDLVerilog HDL是硬件描述語(yǔ)言的一種，用于數(shù)
2010-02-09 08:59:333609 VHDL和Verilog HDL語(yǔ)言對(duì)比
Verilog HDL和VHDL都是用于邏輯設(shè)計(jì)的硬件描述語(yǔ)言，并且都已成為IEEE標(biāo)準(zhǔn)。VHDL是在1987年成為IEEE標(biāo)準(zhǔn)，Verilog HDL
2010-02-09 09:01:1710317 Verilog HDL與VHDL及FPGA的比較分析. Verilog HDL優(yōu)點(diǎn)：類(lèi)似C語(yǔ)言，上手容易，靈活。大小寫(xiě)敏感。在寫(xiě)激勵(lì)和建模方面有優(yōu)勢(shì)。
2011-01-11 10:45:291182 《Verilog HDL 程序設(shè)計(jì)教程》對(duì)Verilog HDL程序設(shè)計(jì)作了系統(tǒng)全面的介紹，以可綜合的設(shè)計(jì)為重點(diǎn)，同時(shí)對(duì)仿真和模擬也作了深入的闡述。《Verilog HDL 程序設(shè)計(jì)教程》以Verilog-1995標(biāo)準(zhǔn)為基礎(chǔ)
2011-09-22 15:53:360 本內(nèi)容介紹了應(yīng)用Verilog HDL進(jìn)行數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例
2011-09-27 16:30:2987 電子發(fā)燒友網(wǎng)站提供《Verilog HDL數(shù)字設(shè)計(jì)與綜合（第二版）.txt》資料免費(fèi)下載
2012-04-04 15:57:240 Verilog_HDL的基本語(yǔ)法詳解（夏宇聞版）:Verilog HDL是一種用于數(shù)字邏輯電路設(shè)計(jì)的語(yǔ)言。用Verilog HDL描述的電路設(shè)計(jì)就是該電路的Verilog HDL模型。Verilog HDL既是一種行為描述的語(yǔ)言也是一種結(jié)
2012-10-08 14:48:310 本書(shū)以實(shí)例講解的方式對(duì)HDL語(yǔ)言的設(shè)計(jì)方法進(jìn)行介紹。全書(shū)共分9章，第1章至第3章主要介紹了Verilog HDL語(yǔ)言的基本概念、設(shè)計(jì)流程、語(yǔ)法及建模方式等。
2012-11-28 13:32:57943 Verilog HDL 數(shù)字設(shè)計(jì)教程【作者：賀敬凱；出版社：西安電子科技大學(xué)出版社】（本資料為ppt） 內(nèi)容簡(jiǎn)介：介紹了Verilog HDL語(yǔ)言，狀態(tài)機(jī)設(shè)計(jì)，仿真，還有好幾個(gè)可綜合設(shè)計(jì)的舉例，除了
2012-11-28 13:43:11489 電子發(fā)燒友網(wǎng)站提供《夏宇聞譯(第二版)-Verilog HDL數(shù)字設(shè)計(jì)與綜合.txt》資料免費(fèi)下載
2014-09-17 00:08:460 電子發(fā)燒友網(wǎng)站提供《Verilog HDL數(shù)字設(shè)計(jì)與綜合_夏宇聞譯（第二版）.txt》資料免費(fèi)下載
2015-09-08 17:43:220 Verilog HDL程序設(shè)計(jì)與實(shí)踐著重介紹了Verilog HDL語(yǔ)言
2015-10-29 14:45:4721 verilog HDL基礎(chǔ)程序135例，適合初學(xué)者。
2015-11-06 09:49:4623 介紹Verilog HDL數(shù)字設(shè)計(jì)與綜合的課件
2015-12-23 10:58:540 Verilog HDL硬件描述語(yǔ)言
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2015-12-29 15:31:270 本書(shū)系統(tǒng)講解了Verilog HDL的基本語(yǔ)法和高級(jí)應(yīng)用技巧，對(duì)于每個(gè)知識(shí)點(diǎn)都按照開(kāi)門(mén)見(jiàn)山、自頂向下的方式來(lái)組織內(nèi)容，在介紹相關(guān)知識(shí)點(diǎn)之前，先告訴讀者其出現(xiàn)的背景、本質(zhì)特征以及應(yīng)用場(chǎng)景，讓讀者不僅
2015-12-31 15:56:367 本章介紹Verilog HDL語(yǔ)言的發(fā)展歷史和它的主要能力。verilog相關(guān)教程材料，有興趣的同學(xué)可以下載學(xué)習(xí)
2016-04-25 16:09:3214 Verilog HDL程序設(shè)計(jì)教程-人郵
2016-05-11 11:30:1934 Verilog HDL實(shí)驗(yàn)練習(xí)與語(yǔ)法手冊(cè)-高教
2016-05-11 11:30:190 Verilog_HDL教程,又需要的朋友下來(lái)看看
2016-05-11 17:30:150 Verilog+HDL實(shí)用教程-電科，下來(lái)看看。
2016-05-11 17:30:1534 Verilog_HDL語(yǔ)言的學(xué)習(xí)，為FPGA編程打下堅(jiān)實(shí)的基礎(chǔ)
2016-05-19 16:40:5212 Verilog HDL應(yīng)用程序設(shè)計(jì)實(shí)例精講。
2016-05-20 11:16:3590 Verilog HDL應(yīng)用程序設(shè)計(jì)實(shí)例精講
2016-05-20 11:16:35284 Verilog HDL 華為入門(mén)教程
2016-06-03 16:57:5345 本文主要介紹了Verilog HDL 語(yǔ)言的一些基本知識(shí)，目的是使初學(xué)者能夠迅速掌握HDL設(shè)計(jì)方法，初步了解并掌握Verilog HDL語(yǔ)言的基本要素，能夠讀懂簡(jiǎn)單的設(shè)計(jì)代碼并能夠進(jìn)行一些簡(jiǎn)單設(shè)計(jì)的Verilog HDL建模。
2016-07-15 15:27:000 verilog HDL，fpga，硬件電路學(xué)習(xí)資料
2016-09-01 14:55:490 設(shè)計(jì)與驗(yàn)證，很不錯(cuò)的一本書(shū)，《設(shè)計(jì)與驗(yàn)證》以實(shí)例講解的方式對(duì)HDL語(yǔ)言的設(shè)計(jì)方法進(jìn)行介紹。全書(shū)共分9章，第1章至第3章主要介紹了Verilog HDL語(yǔ)言的基本概念、設(shè)計(jì)流程、語(yǔ)法及建模方式等內(nèi)容
2016-10-10 17:04:40566 Verilog HDL數(shù)字設(shè)計(jì)與綜合 夏宇聞譯（第二版），感興趣的小伙伴們可以瞧一瞧。
2016-11-11 11:20:110 Verilog HDL硬件描述語(yǔ)言，感興趣的小伙伴們可以瞧一瞧。
2016-11-11 11:20:1111 Verilog HDL設(shè)計(jì)(進(jìn)階)，感興趣的小伙伴們可以瞧一瞧。
2016-11-10 15:29:3615 Verilog HDL設(shè)計(jì)(入門(mén))，感興趣的小伙伴們可以瞧一瞧。
2016-11-10 15:29:3623 Verilog HDL設(shè)計(jì)(提高)，感興趣的小伙伴們可以瞧一瞧。
2016-11-10 15:29:3615 Verilog HDL虛擬器件和虛擬接口模型
2017-02-07 18:25:214 基于FPGA Verilog-HDL語(yǔ)言的串口設(shè)計(jì)
2017-02-16 00:08:5935 本文檔的主要內(nèi)容詳細(xì)介紹的是Verilog HDL入門(mén)教程之Verilog HDL數(shù)字系統(tǒng)設(shè)計(jì)教程。
2018-09-20 15:51:2680 本文檔的主要內(nèi)容詳細(xì)介紹的是常用模塊的Verilog HDL設(shè)計(jì)詳細(xì)資料免費(fèi)下載。
2018-10-16 11:12:5420 本文主要介紹了Verilog HDL 語(yǔ)言的一些基本知識(shí)，目的是使初學(xué)者能夠迅速掌握HDL 設(shè)計(jì)方法，初步了解并掌握Verilog HDL語(yǔ)言的基本要素，能夠讀懂簡(jiǎn)單的設(shè)計(jì)代碼并能夠進(jìn)行一些簡(jiǎn)單設(shè)計(jì)的Verilog HDL建模。
2019-02-11 08:00:0095 Verilog HDL是一種硬件描述語(yǔ)言，以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。 Verilog HDL和VHDL是世界上最流行的兩種硬件描述語(yǔ)言，都是在20世紀(jì)80年代中期開(kāi)發(fā)出來(lái)的。
2019-11-13 07:03:003029 硬件描述語(yǔ)言基本語(yǔ)法和實(shí)踐
（1）VHDL 和Verilog HDL的各自特點(diǎn)和應(yīng)用范圍
（2）Verilog HDL基本結(jié)構(gòu)語(yǔ)言要素與語(yǔ)法規(guī)則
（3） Verilog HDL組合邏輯語(yǔ)句結(jié)構(gòu)
2019-07-03 17:36:0053 的是硬件描述語(yǔ)言。最為流行的硬件描述語(yǔ)言有兩種Verilog HDL/VHDL，均為IEEE標(biāo)準(zhǔn)。Verilog HDL具有C語(yǔ)言基礎(chǔ)就很容易上手，而VHDL語(yǔ)言則需要Ada編程基礎(chǔ)。另外Verilog
2020-09-01 11:47:094002 
本文檔的主要內(nèi)容詳細(xì)介紹的是Verilog HDL教程135例免費(fèi)下載。
2021-01-21 16:30:5353 1、如何使用Verilog HDL描述可綜合電路 Verilog 有什么奇技淫巧？我想最重要的是理解其硬件特性。Verilog HDL語(yǔ)言僅是對(duì)已知硬件電路的文本描述。所以編寫(xiě)前： 對(duì)所需實(shí)現(xiàn)的硬件
2021-04-04 11:19:003838 
簡(jiǎn)單介紹Verilog HDL語(yǔ)言和仿真工具。
2021-05-06 16:17:10617 Verilog HDL是一種以文本形式描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的硬件描述語(yǔ)言，也可描述邏輯電路圖、邏輯表達(dá)式等。Verilog HDL和VHDL是目前主流的、最受歡迎的兩種硬件描述語(yǔ)言。
2021-07-23 14:36:559911 Verilog HDL入門(mén)教程.pdf
2021-11-02 16:27:14108 （70）Verilog HDL測(cè)試激勵(lì)：復(fù)位激勵(lì)21.1 目錄1）目錄2）FPGA簡(jiǎn)介3）Verilog HDL簡(jiǎn)介4）Verilog HDL測(cè)試激勵(lì)：復(fù)位激勵(lì)25）結(jié)語(yǔ)1.2 FPGA簡(jiǎn)介FPGA
2021-12-29 19:42:091 （69）Verilog HDL測(cè)試激勵(lì)：時(shí)鐘激勵(lì)21.1 目錄1）目錄2）FPGA簡(jiǎn)介3）Verilog HDL簡(jiǎn)介4）Verilog HDL測(cè)試激勵(lì)：時(shí)鐘激勵(lì)25）結(jié)語(yǔ)1.2 FPGA簡(jiǎn)介FPGA
2021-12-29 19:42:190 （77）Verilog HDL測(cè)試激勵(lì)：復(fù)位激勵(lì)31.1 目錄1）目錄2）FPGA簡(jiǎn)介3）Verilog HDL簡(jiǎn)介4）Verilog HDL測(cè)試激勵(lì)：復(fù)位激勵(lì)35）結(jié)語(yǔ)1.2 FPGA簡(jiǎn)介FPGA
2021-12-29 19:42:390 （76）Verilog HDL測(cè)試激勵(lì)：時(shí)鐘激勵(lì)31.1 目錄1）目錄2）FPGA簡(jiǎn)介3）Verilog HDL簡(jiǎn)介4）Verilog HDL測(cè)試激勵(lì)：時(shí)鐘激勵(lì)35）結(jié)語(yǔ)1.2 FPGA簡(jiǎn)介FPGA
2021-12-29 19:43:002 Verilog HDL入門(mén)教程-Verilog HDL的基本語(yǔ)法
2022-01-07 09:23:42159 Verilog HDL 入門(mén)教程
2022-08-08 14:36:225 在前一章中，我們介紹了Verilog HDL提供的內(nèi)置基本門(mén)。本章講述Verilog HDL指定用戶定義原語(yǔ)U D P的能力。
2022-08-08 11:46:46733 電子發(fā)燒友網(wǎng)站提供《在Verilog HDL中使用分頻器的8位計(jì)數(shù)器的設(shè)計(jì).zip》資料免費(fèi)下載
2023-06-15 10:14:440 節(jié)通過(guò)硬件描述語(yǔ)言Verilog HDL對(duì)二十進(jìn)制編碼器的描述，介紹Verilog HDL程序的基本結(jié)構(gòu)及特點(diǎn)。
2023-08-28 09:54:341116 
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