③ 設(shè)計(jì)中所有吸收功耗的信號(hào)當(dāng)中，時(shí)鐘是罪魁禍?zhǔn)住ｋm然時(shí)鐘可能運(yùn)行在 100 MHz，但從該時(shí)鐘派生出的信號(hào)卻通常運(yùn)行在主時(shí)鐘頻率的較小分量（通常為 12%～15%）。此外，時(shí)鐘的扇出一般也比較高。這兩個(gè)因素顯示，為了降低功耗，應(yīng)當(dāng)認(rèn)真研究時(shí)鐘。 首先，如果設(shè)計(jì)的某個(gè)部分可以處于非活動(dòng)狀態(tài)，則可以考慮禁止時(shí)鐘樹翻轉(zhuǎn)，而不是使用時(shí)鐘使能。時(shí)鐘使能將阻止寄存器不必要的翻轉(zhuǎn)，但時(shí)鐘樹仍然會(huì)翻轉(zhuǎn)，消耗功率[4]。其次，隔離時(shí)鐘以使用最少數(shù)量的信號(hào)區(qū)。不使用的時(shí)鐘樹信號(hào)區(qū)不會(huì)翻轉(zhuǎn)，從而減輕該時(shí)鐘網(wǎng)絡(luò)的負(fù)載。合理的布局可以在不影響實(shí)際設(shè)計(jì)的情況下達(dá)到此目標(biāo)。

④ 根據(jù)預(yù)測(cè)的下一狀態(tài)條件列舉狀態(tài)機(jī)，并選擇常態(tài)之間轉(zhuǎn)換位較少的狀態(tài)值，這樣就能盡可能減少狀態(tài)機(jī)網(wǎng)絡(luò)的轉(zhuǎn)換量（頻率）。確定常態(tài)轉(zhuǎn)換和選擇適當(dāng)?shù)臓顟B(tài)值，是降低功耗且對(duì)設(shè)計(jì)影響較小的一種簡(jiǎn)單方法。編碼形式越簡(jiǎn)單（如1位有效編碼或格雷碼），使用的解碼邏輯也會(huì)越少[5]。

⑤ 要計(jì)算覆蓋整個(gè)產(chǎn)品生命周期或預(yù)期電池工作時(shí)間內(nèi)所有狀態(tài)下的功耗,要考慮上電、待機(jī)、空閑、動(dòng)態(tài)和斷電等多種狀態(tài)，要計(jì)算最壞情況下的靜態(tài)功耗。

在所有降低功耗的措施中，選擇合適的低功耗器件起決定性的作用，帶來(lái)的效果是立竿見影的，而且無(wú)需花費(fèi)大量的時(shí)間、精力和成本采取額外的措施。所以，選擇一款低功耗的FPGA器件有助于提高產(chǎn)品性能，降低產(chǎn)品成本，提高產(chǎn)品的可靠性。下面介紹Actel公司的低功耗FPGA——IGLOO。

2 低功耗FPGA——IGLOO

Actel公司的IGLOO源于ProASIC3系列，保持了ProASIC3原有的所有特性：?jiǎn)涡酒⒏甙踩浴⒏呖煽啃浴⒏咝阅堋⒌凸摹⒌统杀镜龋?duì)低功耗的特性作了加強(qiáng)。IGLOO器件采用 Flash*Freeze技術(shù)，能夠輕易地進(jìn)入和退出超低功耗模式，該模式下的功耗僅 5 μW，同時(shí)可保存 SRAM和寄存器中的數(shù)據(jù)。Flash*Freeze技術(shù)通過(guò) I/O和時(shí)鐘管理簡(jiǎn)化了功率管理，并無(wú)需關(guān)斷電壓、I/O或系統(tǒng)層面的時(shí)鐘，進(jìn)入和退出 Flash*Freeze模式所需的時(shí)間少于1 μs。 Actel IGLOO系列以 Flash可重編程技術(shù)為基礎(chǔ)，支持安全的系統(tǒng)內(nèi)可編程功能，因此能在制造的最終階段或應(yīng)用現(xiàn)場(chǎng)快速且容易地進(jìn)行升級(jí)或設(shè)計(jì)更新[6]。

IGLOO能夠做到如此低的功耗，主要是由以下幾個(gè)原因決定。
（1） 獨(dú)特的Flash開關(guān)
IGLOO采用了低功耗的Flash開關(guān)，如圖2所示。Flash開關(guān)只需要2個(gè)晶體管，而SRAM的開關(guān)至少需要4個(gè)以上的晶體管。更少的晶體管具有更小的容性負(fù)載、更小的漏電流，從而具有更低的功耗。另外，F(xiàn)lash技術(shù)的開關(guān)具有非易失性的特點(diǎn)，使得IGLOO無(wú)需配置芯片，從而較SRAM的FPGA少了上電的啟動(dòng)電流和配置電流。一般SRAM的FPGA啟動(dòng)電流都需要幾百mA甚至幾A，配置電流也需要幾十mA，不適合用于電池供電的系統(tǒng)[6]。

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圖2 Flash開關(guān)和SRAM開關(guān)的對(duì)比

（2） 更低的內(nèi)核電壓
IGLOO的內(nèi)核可以支持1.2 V或1.5 V供電，1.2 V的內(nèi)核電壓比1.5 V的內(nèi)核電壓可以節(jié)省36%的動(dòng)態(tài)功耗。可由式（1）推導(dǎo)出來(lái)，動(dòng)態(tài)功耗與內(nèi)核電壓的平方成正比，所以1.2 V的IGLOO系統(tǒng)比1.5 V內(nèi)核電壓的系統(tǒng)可以節(jié)省更多的功耗。

（3） 低功耗的Flash*Freeze模式
IGLOO具有一種獨(dú)特的Flash*Freeze模式。在這種模式下可以讓FPGA進(jìn)入睡眠狀態(tài)。在這種模式下最低的功耗可達(dá)2 μW（IGLOO的Nano系列），并且能夠保存RAM和寄存器的狀態(tài)。進(jìn)入和退出這種模式只需要通過(guò)FPGA的Flash*Freeze引腳控制即可，進(jìn)入和退出只需要1 μs，非常方便。

（4） 具有低功耗布局布線工具
Actel提供免費(fèi)的開發(fā)環(huán)境——Libero，并充分考慮了低功耗的設(shè)計(jì)，在軟件中增加了功耗驅(qū)動(dòng)的布局布線。在該方式的驅(qū)動(dòng)下，軟件自動(dòng)以最低功耗的方式來(lái)布局并走線，類似于PCB繪制時(shí)的布局與走線。其中影響最大的是時(shí)鐘的走線，因?yàn)樵诖蟛糠值脑O(shè)計(jì)中時(shí)鐘對(duì)功耗起了關(guān)鍵性的影響。經(jīng)過(guò)功耗驅(qū)動(dòng)的布局布線以后，時(shí)鐘走線變得更有規(guī)則，連線也盡量短，從而大大降低了功耗，通過(guò)該方式最多可以節(jié)省30%的功耗。

另外，在Libero軟件內(nèi)部集成的Modelsim仿真軟件中，提供了功率估算工具。它用于分析實(shí)際器件利用率，并結(jié)合實(shí)際的適配后仿真數(shù)據(jù)，給出實(shí)際功耗數(shù)據(jù)，可以在完全不接觸芯片的情況下分析設(shè)計(jì)改變對(duì)總功耗的影響。

3 小結(jié)

通過(guò)上面的分析,了解了FPGA功率損耗的相關(guān)原理和影響功耗的相關(guān)因素。設(shè)計(jì)者通過(guò)優(yōu)化自己的設(shè)計(jì)和注意某些具體情況,可以在FPGA設(shè)計(jì)中實(shí)現(xiàn)低功耗。通過(guò)一款具體的FPGA產(chǎn)品了解其低功耗的解決方式，為設(shè)計(jì)提供了指導(dǎo)。FPGA均可在相應(yīng)的操作環(huán)境下進(jìn)行仿真，從而了解功耗的具體使用情況，針對(duì)相應(yīng)的情況進(jìn)行修改。另外，還可采用優(yōu)化的算法來(lái)減少多余和無(wú)意義的開關(guān)活動(dòng)，來(lái)實(shí)現(xiàn)低功耗的解決方案。

參考文獻(xiàn)
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