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FPGA IP之AXI4接口信號說明

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2023-05-24 15:05:46842

FPGA AXI4協議學習筆記(三)

上文FPGA IPAXI4協議1_信號說明AXI協議5個通道的接口信息做了說明,本文對上文說的信號進行詳細說明
2023-05-24 15:06:41669

Xilinx FPGA AXI4總線(一)介紹【AXI4】【AXI4-Lite】【AXI-Stream】

FPGA 應用角度看看 AMBA 總線中的 AXI4 總線。
2023-06-21 15:21:441729

Xilinx FPGA AXI4總線(二)用實例介紹5個讀寫通道

AXI4協議是一個點對點的主從接口協議,數據可以同時在主機(Master)和從機(Slave)之間**雙向** **傳輸** ,且數據傳輸大小可以不同。
2023-06-21 15:26:431388

自定義AXI-Lite接口IP及源碼分析

在 Vivado 中自定義 AXI4-Lite 接口IP,實現一個簡單的 LED 控制功能,并將其掛載到 AXI Interconnect 總線互聯結構上,通過 ZYNQ 主機控制,后面對 Xilinx 提供的整個 AXI4-Lite 源碼進行分析。
2023-06-25 16:31:251913

基于Xilinx FPGA AXI-EMC IP的EMIF通信測試

外部存儲器接口( EMIF )通信常用于FPGA和DSP之間的數據傳輸,即將FPGA作為DSP的外部SRAM、或者協同處理器等。Xilinx提供了AXI-EMC IP核,將其掛載到AXI總線用于
2023-08-31 11:25:412357

LogiCORE JTAG至AXI Master IP核簡介

LogiCORE JTAG至AXI Master IP核是一個可定制的核,可生成AXIAXI總線可用于處理和驅動系統中FPGA內部的AXI信號AXI總線接口協議可通過IP定制Vivado
2023-10-16 10:12:42410

AXI傳輸數據的過程

AXI4為例,有AXI full/lite/stream之分。 在Xilinx系列FPGA及其有關IP核中,經常見到AXI總線接口AXI總線又分為三種: ?AXI-Lite,AXI-Full以及
2023-10-31 15:37:08386

漫談AMBA總線-AXI4協議的基本介紹

本文主要集中在AMBA協議中的AXI4協議。之所以選擇AXI4作為講解,是因為這個協議在SoC、IC設計中應用比較廣泛。
2024-01-17 12:21:22224

PCIe控制器(FPGA或ASIC),PCIe-AXI-Controller

Transaction Layer的所有功能特性,不僅內置DMA控制器,而且具備AXI4用戶接口,提供一個高性能,易于使用,可定制化的PCIe-AXI互連解決方案,同時適用于ASIC和FPGA
2024-02-21 15:15:03144

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