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      TMS320C6474 多核數(shù)字信號(hào)處理器

      數(shù)據(jù)：

      描述

      TMS320C64x + DSP（包括TMS320C6474器件）是TMS320C6000?DSP平臺(tái)中性能最高的多核DSP產(chǎn)品。

      C6474器件基于德州儀器（TI）開(kāi)發(fā)的第三代高性能，先進(jìn)的VelociTI?超長(zhǎng)指令字（VLIW）架構(gòu)。

      C64x +?器件為向上代碼 - 與以前作為C6000?DSP平臺(tái)一部分的設(shè)備兼容。

      特性

      • 主要特性
        • 高性能多核DSP（C6474）
        • 指令周期時(shí)間：0.83 ns （1.2GHz設(shè)備）; 1 ns（1 GHz設(shè)備）; 1.18 ns（850 MHz器件）
        • 時(shí)鐘頻率：1 GHz至1.2 GHz（1.2 GHz器件）; 1 GHz（1 GHz設(shè)備）; 850 MHz（850 MHz器件）
        • 商用溫度和擴(kuò)展溫度
        • 3個(gè)TMS320C64x +?DSP內(nèi)核; 6個(gè)用于CDMA處理的RSA（每個(gè)核心2個(gè)）
        • 增強(qiáng)型VCP2 /TCP2
        • 幀同步接口
        • 16- /32-bit DDR2-667內(nèi)存控制器< /li>
        • EDMA3控制器
        • 天線接口
        • 兩個(gè)1x串行RapidIO?鏈路，符合v1.2標(biāo)準(zhǔn)
        • 一個(gè)1.8V內(nèi)部集成電路（I2C）總線
        • 兩個(gè)1.8 V McBSP
        • 1000 Mbps以太網(wǎng)MAC（EMAC）
        • 六個(gè)64位通用定時(shí)器
          • < li> 16個(gè)通用I /O（GPIO）引腳
        • 內(nèi)部信號(hào)量模塊非UMTS系統(tǒng)
        • 系統(tǒng)PLL和PLL控制器/DDR PLL和PLL控制器，專用于DDR2內(nèi)存控制器
      • 高性能多核DSP（C6474）
        • 指令周期時(shí)間：
          • 1.2-GHz器件：1.0-ns至0.83 -ns
          • 1-GHz設(shè)備：1-ns
          • 850-MHz設(shè)備：1.18 ns
        • 時(shí)鐘頻率：< ul>
        • 1.2 GHz設(shè)備：1 GHz至1.2 GHz
        • 1 GHz設(shè)備：1 GHz
        • 850 MHz設(shè)備：850 MHz
      • 八個(gè)32-B說(shuō)明/循環(huán)
      • 商用溫度：
        • 1.2-GHz設(shè)備：0°C至95°C
        • 1-GHz設(shè)備：0°C至100° C
        • 850-MHZ和1-GHz器件：0°C至100°C
      • 擴(kuò)展溫度：
        • 1.2- GHz器件：-40°C至95°C <小> （1）
        • 1 GHz器件：-40°C至100°C
    • 3 TMS320C64x +?DSP內(nèi)核
      • 專用SPLOOP指令
      • 緊湊指令（16 -Bit）
      • 異常處理
    • TMS320C64x + Megamodule L1 /L2內(nèi)存架構(gòu)
      • 256 K-Bit（32 K-Byte） L1P程序高速緩存[直接映射]
      • 256 K位（32 K字節(jié)）L1D數(shù)據(jù)高速緩存[2路組關(guān)聯(lián)]
      • 512 K-Bit（64 K-字節(jié)）L3 ROM
    • 增強(qiáng)型VCP2
      • 支持超過(guò)694 7.95-Kbps AMR
    • 增強(qiáng)Turbo解碼器協(xié)處理器（TCP2）
      • 支持最多8個(gè)2 Mbps 3 GPP（6個(gè)迭代）
    • Endianness：Little Endian，Big Endian < /li>
    • 幀同步接口
      • 內(nèi)部子系統(tǒng)，外部設(shè)備/系統(tǒng)之間的時(shí)間對(duì)齊
      • 符合OBSAI RP1的幀突發(fā)數(shù)據(jù)
      • 非替換接口-RP1和非UMTS系統(tǒng)
    • 16/32位DDR2-667內(nèi)存控制器
    • EDMA3控制器（64個(gè)獨(dú)立通道）
    • 天線接口
      • 6個(gè)可配置鏈路（全雙工）
      • 支持OBSAI RP3協(xié)議，v1.0：768-Mbps，1.536-，3.072-Gbps鏈路速率
      • 支持CPRI協(xié)議V2.0：614.4-Mbps，1.2288-，2.4576-Gbps鏈路速率
      • 時(shí)鐘輸入獨(dú)立或與CPU共享（在引導(dǎo)時(shí)可選）
    • 兩個(gè)1x串行RapidIO?鏈路，符合v1.2
      • 1.25-，2.5-，3.125-Gbps鏈路速率
      • 消息傳遞和DirectIO支持< /li>
      • 錯(cuò)誤管理擴(kuò)展和擁塞控制
    • 一個(gè)1.8V內(nèi)部集成電路（I2C）總線
    • 兩個(gè)1.8V McBSPs
    • 1000 Mbps以太網(wǎng)MAC（EM AC）
      • IEEE 802.3兼容
      • 支持SGMII，v1.8兼容
      • 8個(gè)獨(dú)立發(fā)送（TX）和8個(gè)獨(dú)立接收（RX）信道
    • 六個(gè)64位通用定時(shí)器
      • 最多可配置12個(gè)32位定時(shí)器
      • 可在看門(mén)狗定時(shí)器模式下配置
    • 16個(gè)通用I /O（GPIO）引腳
    • 內(nèi)部信號(hào)量模塊
      • 控制對(duì)共享資源的訪問(wèn)的軟件方法
      • 32通用信號(hào)量資源
    • 系統(tǒng)PLL和PLL控制器
    • DDR PLL和PLL控制器，專用于DDR2內(nèi)存控制器
    • IEEE-1149.1和IEEE-1149.6（JTAG?）邊界掃描兼容
    • 561針球柵陣列（BGA）封裝（CUN，GUN或ZUN后綴），0.8毫米球間距
    • 0.065-μm/7-Level Cu金屬工藝（CMOS）
    • SmartReflex?0類使能 - 0.9 V至1.2 V自適應(yīng)核心電壓
    • 1.8-V，1.1-VI /Os

      • （1） 不e：本文檔中提供了有關(guān)C6474 1.2 GHz擴(kuò)展溫度設(shè)備的高級(jí)信息。

      所有商標(biāo)均為其各自所有者的財(cái)產(chǎn)。

      參數(shù) 與其它產(chǎn)品相比?其他 C6000 DSP

      ?
      DSP
      TMS320C6474
      3 C64x+ ? ?

      方框圖 (1)

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