前一篇文章我們介紹了通過小腳丫FPGA核心開發板來進行門電路的實驗過程。當然，我們還可以畫出更多復雜的門電路組合，并且通過小腳丫FPGA輕松實現對應的輸入/輸出特性的定義。現在，我們利用小腳丫來學習更多具有特定功能的實用組合邏輯電路。

本篇中，我們希望設計一個二進制比較器，通過小腳丫FPGA搭建實驗電路并驗證結果。

顧名思義，二進制比較器就是比較兩個二進制數的大小，因此對于一個兩位輸入的比較器來說，其輸出結果不外乎有小于，大于和等于三種可能。因此我們列出這個電路的真值表。

表1 二進制比較器真值表

相信學習過數字電路課程的同學都知道如何將該電路進行邏輯運算，化簡并畫出對應的門電路組合，因此該步驟我們不在此過多贅述，直接上圖。

圖1 電路圖

圖2 門電路組合

通過Verilog代碼，我們對該電路進行硬件描述。這次我們采用Data-flow的寫法，代碼中出現的!&^等符號，實際上就是等于同直接對數據進行邏輯運算，并分別對應NOT, AND, OR。希望大家之后對這些符號的熟悉程度就如同看￥$€等符號一樣親切。

module comparer1
    (
      inputwire A,           //定義輸入的兩個數a、b
      inputwire B,
      outputwire Y2,     //定義三種輸出結果對應的led
      outputwire Y0,
      outputwire Y1
    );
    
    assign Y2 =(!A) & B;    //對應A< B
    assign Y1 = A & (!B);    //對應A >B
    assign Y0 =!(A^B);      //對應A=B
    
  endmodule

在完成代碼編譯后，我們將輸入變量A和B以及輸出變量Y2,Y1,Y0分別對應至小腳丫的板載外設上。

表2 各變量對應小腳丫相應引腳

這樣，我們就在小腳丫上構建了一個二進制比較器，我們可以通過調節輸入編碼開關，并觀察LED燈的現象來驗證我們的設計。

文章的最后我們提兩個問題：

1.如果我們將開關SW1, SW2撥至如下圖所示，L1,L2,L3所對應的狀態應該是怎樣的？

注意：小腳丫板載的LED是低電平點亮，也就是說，當輸出為1時，LED熄滅，反之則亮。

圖3

2.假如現在小腳丫上L2、L3處于點亮狀態，那么撥碼開關SW1和SW2現在應該是什么狀態？（圖中將撥碼開關放置中間未知僅為示意作用，實際不存在中間狀態）。

圖4

是不是入手很簡單，隨后能夠很方便地做擴展和結果驗證？