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傳統衛星星載設備使用并行傳輸結構提高數據傳輸速率，隨著星載設備數據處理能力的提高，繼續采用并行傳輸的方式提高速率將引入一些問題。一是在接收端對多路并行數據的同步將變的困難。二是衛星內部數據傳輸線的過多會增加衛星重量，增加衛星發射成本。日前市面上的主流工業級FPGA芯片都集成各自開發的高速串行收發器，能達到很高的數據傳輸速率，但是衛星上使用的宇航級FPGA芯片中，卻少有集成高速串行收發器，在國防軍事衛星上使用國外廠商的黑盒IP核對于整個衛星系統的可靠性控制會產生不可預測的風險。
文中通過對現有的各主流廠商的FPGA集成的高速串行收發器不同方案的分析，提出一種能夠在FPGA設計中方便調用的高速串行收發器IP核，該IP核具有8BIOB編解碼，時鐘數據恢復等功能，具有實現資源消耗少，速度快，移植性好，可靠性高等特點。
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