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電子發燒友網>電子資料下載>可編程邏輯>EDA-教程>PCB設計規則>高速電路信號完整性分析與設計—時序計算

高速電路信號完整性分析與設計—時序計算

2009-10-06 | rar | 555 | 次下載 | 免費

資料介紹

高速電路信號完整性分析與設計—時序計算:基本概念
引入:在數字電路中,從一個芯片信息A到另一個芯片變成信息B,那么這個數字系統失敗;如何保證信息不變?關鍵點,就是在傳輸過程的任意點都保持時序的正確性。
??時序概念:在數字電路中表達一種信息狀態的一組數字信號的相位關系。
??應用環境:數字電路
??電路組成部件:CPU、存儲器、邏輯器件
同步時序電路:所有的時鐘連接在一起,并使觸發器同時翻轉,延時固定.
異步時序電路:時鐘不連接在一起,觸發器不同時翻轉,延時積累。
互連設計中時序電路為同步時序電路,在這種電路中信號傳輸的實質是:在發送端,用時鐘信號從存儲器中讀出數據或地址控制信號;在接收端,用時鐘信號去鎖存數據或地址控制信號。
存儲器和鎖存器的實質就是觸發器,所以研究觸發器的延時參數和鎖存參數是時序分析的關鍵
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