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電子發燒友網>電子資料下載>DSP>LTE系統中Turbo編碼的理論分析

LTE系統中Turbo編碼的理論分析

2017-10-27 | rar | 0.6 MB | 次下載 | 1積分

資料介紹

通過對常用Turbo編碼原理的研究分析,提出了一種簡單有效的Turbo編碼實現方案,該方案已經在TMS320C64× DSP中實現。將Turbo編碼程序在CCS3.3中運行,驗證了方案的可行性、高效性。該方案已應用于LTE-TDD無線綜合測試儀表的開發中。
  信道編碼是消除或降低信息傳輸錯誤概率的有效手段之一。根據Shannon有噪信道編碼定理,在信道傳輸速率R不超過信道容量C的前提下,只有在碼組長度無限的碼集合中隨機地選擇編碼碼字并且在接收端采用最大似然譯碼算法時,才能使誤碼率接近為零。Turbo編碼[1]巧妙地將卷積碼和隨機交織器結合在一起,獲得了接近Shannon理論極限的譯碼性能。
  Turbo碼又稱并行級聯卷積碼PCCC(Parallel Concatenated Convolutional Code),它將卷積碼和隨機交織器結合,實現了隨機編碼的思想,在實現隨機編碼思想的同時,通過交織器實現了由短碼構造長碼的方法。Turbo碼由分量碼經由交織器級聯而成。分量碼和交織器設計的好壞是決定Turbo碼性能的關鍵因素。Turbo碼的提出,不僅提供了一個性能優越的編碼方法,還更新了編碼理論研究中的一些概念和方法。由于Turbo碼具有接近Shannon理論極限的性能[2],尤其是低信噪比下的優異性能,使Turbo碼成為第三代移動通信高質量、高速率信道中的首選編碼方法。
  1 LTE系統中的Turbo編碼
  LTE作為準4 G技術,以正交頻分復用OFDM和多輸入多輸出MIMO技術為基礎,下行采用正交頻分多址(OFDM)技術,上行采用單載波頻分多址(SC-FDMA)技術,在20 MHz頻譜帶寬下能夠提供下行100 Mb/s與上行50 Mb/s的峰值速率。
  在LTE系統中,Turbo編碼主要應用于上行共享信道、下行共享信道、尋呼信道和多播信道的信道編碼[3]處理。由MAC層傳來的數據和控制信息比特流經過添加CRC以及碼塊分割后進入編碼單元,編碼完成后進行速率匹配[3-4]。
  0。為了讓編碼器從0狀態開始且編碼之后回到0狀態,編碼后的輸出比特數為D=K+4,最后的4個比特被稱為柵格停止尾比特。Turbo編碼器結構如圖1 所示。
  
  2 Turbo編碼算法分析
  Turbo編碼原理相對簡單,主要由兩個子編碼器和內交織器組成。每次輸入一個碼塊數據流,兩個子編碼器結構一樣,可以并行處理,其中輸入在進入第二個編碼器之前要先進入一個交織單元,經交織后作為輸入比特序列,然后進入第二個編碼器處理[2]。輸出三路數據,分別為信息比特流、校驗比特流1、校驗比特流2。本文提出采用查表法來實現Turbo編碼的算法。
  具體算法描述如下:
  (1)碼塊分割完后可能出現不同碼塊大小(K+,K-),算法采用每個碼塊單獨處理。所以需要定義一個標識來查表當前碼塊需要交織時的參數
  (2)Turbo編碼時有反饋的影響,即每個輸入比特與反饋值做了“異或”后才能作為移位寄存器的下一個狀態,故在實際DSP實現過程中使用了逐位比特處理的方式。
  (3)由于Turbo編碼器上下兩部分處理方法一樣,所以在處理上半部分編碼器時同時并行處理下半部分,而下半部分輸入是經過交織之后的輸出比特序列。
  (4)根據不同的f1和f2可以有不同的結果。f1和f2一共有188種配對,規律性低,本文只能采用一比特一比特按照公式計算出對應位置,然后進行交織。
  (5)采用查表的方式,每輸入一個比特加上現在寄存器里面的3個比特作為一個狀態(一共4個比特16種狀態,輸入比特作為最低位),可以查出一個輸出比特和下一個寄存器狀態。
  (6)在尾比特的處理上,每一路的最后3位尾比特與輸入無關,只與現在寄存器的狀態有關(3 bit 一共8種狀態)。本文全部列出了8種狀態下可能出現的結果。在DSP實現功能時直接判斷現在的寄存器處于哪種狀態,然后利用查表可以得出3個尾比特。
  (7)最后對四路輸出的尾比特(3×4=12 bit)按標準做一個賦值處理,然后移位接到之前的比特序列中去就可以得到最終的三路輸出比特序列。
  3 Turbo編碼算法的DSP實現
  3.1 硬件
  TMS320C6000系列DSP是TI公司推向市場的高性能DSP,綜合了目前性價比高、功耗低等優點。TMS320C64系列在TMS320C6000×DSP芯片中處于領先水平,它不但提高了時鐘頻率,而且在體系結構上采用了VelociTI 甚長指令集VLIW(Very Long Instruction Word)結構[5],芯片內有8個獨立功能單元的內核,每個周期可以并行執行8條32 bit指令,最大峰值速度為4 800 MIPS,2組共64個32 bit通用寄存器,32 bit尋址范圍,支持8/16/32/40 bit的數據訪問,芯片內集成大容量SRAM,最大可達8 Mbit。由于其出色的運算能力、高效的指令集、大范圍的尋址能力,使其特別適用于無線基站、測試儀表等對運算能力和存儲量要求高的應用場合。
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