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本文采用中芯國(guó)際(SMIC)O.25“m cMOS工藝來(lái)設(shè)計(jì)符合I阻E 802.1lb
標(biāo)準(zhǔn)規(guī)定的2.4GHz無(wú)線局域網(wǎng)芯片中可變?cè)鲆?a href='http://www.1cnz.cn/tags/放大器/' target='_blank' class='arckwlink_none'>放大器和直流失調(diào)補(bǔ)償電路。收
發(fā)器采用零中頻(Zero—IF)結(jié)構(gòu)，便于將整個(gè)系統(tǒng)集成在一塊芯片上。零中頻
收發(fā)器不需要鏡像抑制濾波器和聲表面濾波器，也不用考慮放大器和濾波器的
匹配問題。設(shè)計(jì)的難點(diǎn)在于本振泄漏、直流失調(diào)、1/f噪聲，本文分別對(duì)它們
進(jìn)行了分析，并在VGA中解決了直流失調(diào)。
本文主要工作是對(duì)可變?cè)鲆娣糯笃?/u>的研究和設(shè)計(jì)。增益可變范圍和步長(zhǎng)控
制是可變?cè)鲆娣糯笃髯顬橹匾闹笜?biāo)，因此本文對(duì)CMOS可變?cè)鲆娣糯笃鞯幕?/P>
本拓?fù)浣Y(jié)構(gòu)和主要性能指標(biāo)做了一些總結(jié)，并從改善控制范圍、步長(zhǎng)精度和功
耗等角度進(jìn)行電路的設(shè)計(jì)。可變?cè)鲆娣糯笃鞑捎肕OS管分流網(wǎng)絡(luò)而非傳統(tǒng)的
電阻網(wǎng)絡(luò)，解決了電阻之間的匹配問題，同時(shí)得到的步長(zhǎng)也更為精確，使得增
益可控范圍為O.72dB，步長(zhǎng)精度為2dB，極大地降低了功耗并且節(jié)省了芯片的
面積。
本文的另一個(gè)工作是解決無(wú)線局域網(wǎng)收發(fā)器零中頻結(jié)構(gòu)中的直流失調(diào)補(bǔ)償
問題，巧妙地利用QPSK調(diào)制方式來(lái)降低直流附近有用信號(hào)的頻譜能量，使得
直流失調(diào)補(bǔ)償后對(duì)有用信號(hào)的破壞降到最低;電路設(shè)計(jì)采用負(fù)反饋來(lái)實(shí)現(xiàn)補(bǔ)償，
得到高通轉(zhuǎn)折頻率為lKHz。
整個(gè)設(shè)計(jì)采用Cadence公司的Spectre工具仿真，版圖設(shè)計(jì)用Cadence公司
的Ⅵrtuoso來(lái)完成。最終的面積控制在o，14mm2以下，功耗為32mw。
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