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在Cadence Allegro/OrCAD PCB SI中，我們可以方便地提取PCB上的傳輸線及過孔的模型進入到Cadence SigXplorer中，即可清晰明了地看到各段傳輸線的特征阻抗等參數。但是，整個傳輸通道中，并不是所有部分都提供了.brd或.mcm這些Cadence所支持的電路板或襯底設計文件，例如，連接器廠商針對高速接插件通常會提供S參數或Spice模型，我們并不能夠直接從這些模型中直接看出其阻抗特性，也就不能直觀的了解這部分傳輸通路是否會因為阻抗不連續而引起信號的反射。這時，我們可以執行TDR仿真，即針對這部分電路或整個傳輸通道搭建一個TDR（Time Domain Refletometer，時域反射儀）環境，然后添加一個極短上升時間（一般100ps以內）、輸出阻抗為定值（一般是單邊50ohm和差分100ohm）的激勵，測量輸出端口的電壓曲線，并可分析得出待測電路（DUT）的阻抗特性。 ?Cadence Allegro/OrCAD PCB SI和業界多數SI仿真工具一樣，都支持TDR仿真，我們可以在SigXplorer中仿真分析待測電路的阻抗特性。
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