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本文介紹了一種通過單邊帶來估計(jì)時(shí)鐘源的相位噪聲的通用公式。載波比（SSCR），振蕩周期的周期抖動(dòng)。該鏈接允許無縫聚合。
外部時(shí)鐘源相位噪聲，通常以dBC/Hz給出，與片上時(shí)鐘同步電路的相位穩(wěn)定圖相比，通常以PS RMS為準(zhǔn)。這允許依次評(píng)估它們對(duì)采樣電路的總孔徑抖動(dòng)的影響，從而最終能夠確定如系統(tǒng)中所示的類似于數(shù)字轉(zhuǎn)換器的系統(tǒng)的SNR。
時(shí)域和頻域數(shù)字的關(guān)系的有效性首先在雙極和CMOS集成VCO的相位譜上進(jìn)行了測(cè)試；此后，基于PLL的頻率合成器的最流行情況已經(jīng)被采用時(shí)間toApple來處理。轉(zhuǎn)換技術(shù)，或?qū)Ｓ玫南辔辉肼暅y(cè)試設(shè)備。
通過使用這里提出的公式并在250FS中嚴(yán)格量化的優(yōu)化ARTEPOLL抖動(dòng)的狀態(tài)所啟用的最佳性能，在德克薩斯儀器ADS5420上展示，用于3G無線基礎(chǔ)設(shè)施BTS應(yīng)用的高速14B 6MSPS ADC。
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