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基于軟核Nios的寬譜正弦信號發(fā)生器設計

2009-07-22 | rar | 418 | 次下載 | 免費

資料介紹

本設計運用了基于Nios II 嵌入式處理器的SOPC 技術(shù)。系統(tǒng)以ALTERA
公司的Cyclone 系列FPGA 為數(shù)字平臺,將微處理器、總線、數(shù)字頻率合成器、
存儲器和I/O 接口硬件設備集中在一片F(xiàn)PGA 上,利用直接數(shù)字頻率合成
(DDFS)技術(shù)、數(shù)字調(diào)制技術(shù)實現(xiàn)所要求波形的產(chǎn)生,用FPGA 中的ROM
存DDS 所需的波形表,充分利用片上資源,提高了系統(tǒng)的精確度、穩(wěn)定性和抗
干擾性能。使用新的數(shù)字信號處理(DSP)技術(shù),通過在Nios 中軟件編程解決
不同的調(diào)制方式的實現(xiàn)和選擇。系統(tǒng)頻率實現(xiàn)1Hz~20MHz 可調(diào),步進達到了
1Hz;完成了調(diào)幅、調(diào)頻、二進制PSK、二進制ASK、二進制FSK 調(diào)制和掃頻
輸出的功能。
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