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《Verilog HDL 程序設(shè)計(jì)教程》對(duì)Verilog HDL程序設(shè)計(jì)作了系統(tǒng)全面的介紹，以可綜合的設(shè)計(jì)為重點(diǎn)，同時(shí)對(duì)仿真和模擬也作了深入的闡述。《Verilog HDL 程序設(shè)計(jì)教程》以Verilog-1995標(biāo)準(zhǔn)為基礎(chǔ)，全面介紹了Verilog HDL的詞法、語(yǔ)法、語(yǔ)句，可綜合程序的編寫(xiě)，仿真程序的編寫(xiě)，一般數(shù)字邏輯的實(shí)現(xiàn)，復(fù)雜邏輯和算法的實(shí)現(xiàn)等，討論了設(shè)計(jì)中的方法與技巧，并以大量經(jīng)過(guò)驗(yàn)證的設(shè)計(jì)實(shí)例為依據(jù)，深入淺出地闡述了Verilog程序開(kāi)發(fā)所涉及的各個(gè)方面。對(duì)Verilog-2001的新增語(yǔ)法結(jié)構(gòu)也作了介紹。
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