資料介紹
This quadruple bus buffer gate is designed for 1.65-V to 3.6-V VCC operation.
The SN74ALVC125 features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE)\ input is high.
To ensure the high-impedance state during power up or power down, OE\ should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
- SN74ALVC32,pdf(QUADRUPLE 2-INP
- SN74ALVC00-Q1,pdf(Quadruple 2-
- SN74ALVC00,pdf(QUADRUPLE 2-INP
- SN74ALVC08-Q1,pdf(Quadruple 2-
- SN74ALVC245,pdf(OCTAL BUS TRAN
- SN74LVC125A-Q1,pdf(Quadruple B
- SN74LV125AT,pdf(QUADRUPLE BUS
- SN74F125,pdf(Quadruple Bus Buf
- SN74AUC126,pdf(QUADRUPLE BUS B
- SN74AUC125,PDF(QUADRUPLE BUS B
- SN74ALVC126,pdf(QUADRUPLE BUS
- SN74AHCT125-Q1,pdf(Quadruple B
- SN74AHC125Q,pdf(Quadruple Bus
- SN74AHC125-Q1,pdf(Quadruple Bu
- SN74ABT125Q-Q1,pdf(Quadruple B
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