資料介紹
These devices consist of bus-transceiver circuits with 3-state or open-collector outputs, D-type flip-flops, and control circuitry arranged for multiplexed transmission of data directly from the data bus or from the internal storage registers. Data on the A or B bus is clocked into the registers on the low-to-high transition of the appropriate clock (CLKAB or CLKBA) input. Figure 1 illustrates the four fundamental bus-management functions that can be performed with the octal bus transceivers and registers.
Output-enable () and direction-control (DIR) inputs control the transceiver functions. In the transceiver mode, data present at the high-impedance port may be stored in either or both registers.
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- 8輸入正NAND門SN54ALS30A SN54AS30 SN74ALS30A SN74AS30數(shù)據(jù)表
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- SN54ALS137A,SN74ALS173A,SN74AS
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- SN54ALS191A,SN74ALS191A,PDF(Sy
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- SN54ALS541, SN74ALS540, SN74AL
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