資料介紹
The ’HCT646 devices consist of bus-transceiver circuits with 3-state outputs, D-type flip-flops, and control circuitry arranged for multiplexed transmission of data directly from the input bus or from the internal registers. Data on the A or B bus is clocked into the registers on the low-to-high transition of the appropriate clock (CLKAB or CLKBA) input. Figure 1 illustrates the four fundamental bus-management functions that can be performed with the ’HCT646 devices.
Output-enable (OE)\ and direction-control (DIR) inputs control the transceiver functions. In the transceiver mode, data present at the high-impedance port can be stored in either or both registers.
The select-control (SAB and SBA) inputs can multiplex stored and real-time (transparent mode) data.
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54HCT646 SN74HCT646數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器SN54HCT623 SN74HCT623數(shù)據(jù)表
- 八進(jìn)制總線收發(fā)器和寄存器SN54LS646 THRU SN54LS649 SN74LS646 THRU SN74LS649數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54LVC646A SN74LVC646A數(shù)據(jù)表
- 帶三態(tài)輸出的八進(jìn)制總線收發(fā)器SN54HCT645 SN74HCT645數(shù)據(jù)表
- 帶時鐘使能的八進(jìn)制D型觸發(fā)器SN54HCT377 SN74HCT377 數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制緩沖器和線路驅(qū)動器SN54HCT540 SN74HCT540數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54BCT646 SN74BCT646數(shù)據(jù)表
- 帶三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54ABT646A SN74ABT646A數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存CD54HC646 CD74HCT646 數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54HC646 SN74HC646數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54HCT652 SN74HCT652數(shù)據(jù)表
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- SN54LVC646A, SN74LVC646A,pdf(O
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