資料介紹
This bus-interface register is designed to eliminate the extra packages required to buffer existing registers and provide extra data width for wider address/data paths or buses carrying parity. The CY74FCT823T is a 9-bit-wide buffered register with clock-enable (EN\) and clear (CLR\) inputs that are ideal for parity bus interfacing in high-performance microprogrammed systems. It is ideal for use as an output port requiring high IOL/IOH.
This device is designed for high-capacitance load drive capability, while providing low-capacitance bus loading at both inputs and outputs. Outputs are designed for low-capacitance bus loading in the high-impedance state.
This device is fully specified for partial-power-down applications using Ioff.
- CY74FCT16841AT,pdf(20-Bit Latc
- CY74FCT16373AT,pdf(16-Bit Latc
- CY74FCT162373AT,pdf(16-Bit Lat
- SN74LVC823A,pdf(9-BIT BUS-INTE
- CY74FCT825CT,pdf(8-Bit Bus-Int
- CY74FCT823CT,pdf(9-Bit Bus-Int
- CY74FCT823BT,pdf(9-Bit Bus-Int
- CY74FCT821AT,pdf(10-Bit Bus In
- CY74FCT16823CT,pdf(18-Bit Regi
- CY74FCT16823AT,pdf(16-Bit Regi
- CY74FCT16374AT,pdf(16-Bit Regi
- CY74FCT162823AT,pdf(18-Bit Reg
- CY74FCT162374AT,pdf(16-Bit Reg
- CY74FCT16646AT,pdf(16-Bit Regi
- CY74FCT2827AT,pdf(10-Bit Buffe
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