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The \x92FCT841T bus-interface latches are designed to eliminate additional packages required to buffer existing latches and provide additional data width for wider address/data paths or buses carrying parity. The \x92FCT841T devices are buffered 10-bit-wide versions of the FCT373 function.
The \x92FCT841T devices\x92 high-performance interface is designed for high-capacitance-load drive capability, while providing low-capacitance bus loading at both inputs and outputs. Outputs are designed for low-capacitance bus loading in the high-impedance state.
These devices are fully specified for partial-power-down applications using Ioff. The Ioff?circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.
- CY74FCT841CT,pdf(10-Bit Latche
- CY74FCT841BT,pdf(10-Bit Latche
- CY74FCT16841AT,pdf(20-Bit Latc
- CY74FCT16373AT,pdf(16-Bit Latc
- CY74FCT162373AT,pdf(16-Bit Lat
- CY74FCT821CT,pdf(10-Bit Bus In
- CY74FCT821BT,pdf(10-Bit Bus In
- CY74FCT821AT,pdf(10-Bit Bus In
- CY74FCT16823AT,pdf(16-Bit Regi
- CY74FCT16374AT,pdf(16-Bit Regi
- CY74FCT162374AT,pdf(16-Bit Reg
- CY74FCT2543AT,pdf(8-Bit Latche
- CY74FCT16646AT,pdf(16-Bit Regi
- CY74FCT2827CT,pdf(10-Bit Buffe
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