資料介紹
This 18-bit universal bus transceiver is designed for 1.65-V to 3.6-V VCC operation.
The SN74ALVCH16600 combines D-type latches and D-type flip-flops to allow data flow in transparent, latched, and clocked modes.
Data flow in each direction is controlled by output-enable (OEAB\ and OEBA\), latch-enable (LEAB and LEBA), and clock (CLKAB\ and CLKBA) inputs. The clock can be controlled by the clock-enable (CLKENAB\ and CLKENBA\) inputs. For A-to-B data flow, the device operates in the transparent mode when LEAB is high. When LEAB is low, the A data is latched if CLKAB\ is held at a high or low logic level. If LEAB is low, the A data is stored in the latch/flip-flop on the high-to-low transition of CLKAB\. Output enable OEAB\ is active low.
- SN74LVCH16901,pdf(18-Bit Unive
- SN74ALVCH16901,pdf(18-BIT UNIV
- SN74ALVCH16601,pdf(18-BIT UNIV
- SN74ALVCH16501,pdf(18-BIT UNIV
- SN74ALVCH16500,pdf(18-BIT UNIV
- SN74ALVCH162601,pdf(18-BIT UNI
- SN74ALVCHG162282,pdf(18-BIT TO
- SN74ALVCH16282,pdf(18-Bit To 3
- SN74ALVCH16835,pdf(18-BIT UNIV
- SN74ALVC162835,pdf(18-BIT UNIV
- SN74ALVC162834,pdf(18-BIT UNIV
- SN74ALVCH16823,pdf(18-BIT BUS-
- SN74GTLPH1627,pdf(18-BIT LVTTL
- SN74ALVCH16863,pdf(18-Bit Tran
- SN74ALVCH16825,pdf(18-BIT BUFF
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