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This 18-bit (dual-octal) noninverting registered transceiver is designed for 1.65-V to 3.6-V VCC operation.
The SN74LVCH16901 is a dual 9-bit to dual 9-bit parity transceiver with registers. The device can operate as a feed-through transceiver, or it can generate/check parity from the two 8-bit data buses in either direction.
The SN74LVCH16901 features independent clock (CLKAB or CLKBA), latch-enable (LEAB or LEBA), and dual 9-bit clock-enable (CLKENAB\ or CLKENBA\) inputs. It also provides parity-enable (SEL)\ and parity-select (ODD/EVEN\) inputs and separate error-signal (ERRA\ or ERRB\) outputs for checking parity. The direction of data flow is controlled by output-enable (OEAB\ and OEBA\) inputs. When SEL\ is low, the parity functions are enabled.
- SN74ALVCHR162601,pdf(18-BIT UN
- SN74ALVCH16901,pdf(18-BIT UNIV
- SN74ALVCH16601,pdf(18-BIT UNIV
- SN74ALVCH16600,pdf(18-BIT UNIV
- SN74ALVCH162601,pdf(18-BIT UNI
- SN74ALVCHG162282,pdf(18-BIT TO
- SN74ALVCH16282,pdf(18-Bit To 3
- SN74ALVC16835,pdf(18-BIT UNIVE
- SN74ALVC16834,pdf(18-BIT UNIVE
- SN74GTLPH16927,pdf(18-BIT LVTT
- SN74GTLPH1627,pdf(18-BIT LVTTL
- SN74GTL16923,pdf(18-Bit LVTTL-
- SN74GTL16622A,pdf(18-Bit LVTTL
- SN74ALVCH16863,pdf(18-Bit Tran
- SN74ALVCH16825,pdf(18-BIT BUFF
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