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VHDL語言描述數字系統:本章介紹用 VHDL 描述硬件電路的一些基本手段和基本方法。
?? VHDL 語言是美國國防部在 20 世紀 80 年代初為實現其高速集成電路計劃（VHSIC）而提出的一種 HDL，其含義為超高速集成電路硬件描述語言。
??? VHDL 語言的基本結構是對任何電路在用 VHDL語言描述時，都應有兩部分組成：實體和結構體。實體描述電路的輸入、輸出關系；結構體描述電路的功能。
VHDL 語言描述與邏輯電路圖的對應關系
實體描述:實體在電路中主要是說明該電路的輸入、輸出關系，更具體地說就是用來定義實體與外部的連接關系以及需傳送給實體的參數。
實體描述的一般格式為
ENTITY???? 實體名??? IS
?????? [? GENERIC??? （類屬表說明）；]
?????? [?? PORT???????? （端口表說明）；]
END [ENTITY][實體名]
注意：[ ] 中的部分為可缺省內容
（1）類屬表說明用以將信息參數傳遞到實體。最常用的信息是器件的上升沿到下降沿的延遲時間、負載電容和電阻、驅動能力以及功耗等。
（2）端口表指明實體的輸入、輸出信號及其模式。端口模式共有五種，如下所示。
?? VHDL 語言是美國國防部在 20 世紀 80 年代初為實現其高速集成電路計劃（VHSIC）而提出的一種 HDL，其含義為超高速集成電路硬件描述語言。
??? VHDL 語言的基本結構是對任何電路在用 VHDL語言描述時，都應有兩部分組成：實體和結構體。實體描述電路的輸入、輸出關系；結構體描述電路的功能。
VHDL 語言描述與邏輯電路圖的對應關系
實體描述:實體在電路中主要是說明該電路的輸入、輸出關系，更具體地說就是用來定義實體與外部的連接關系以及需傳送給實體的參數。
實體描述的一般格式為
ENTITY???? 實體名??? IS
?????? [? GENERIC??? （類屬表說明）；]
?????? [?? PORT???????? （端口表說明）；]
END [ENTITY][實體名]
注意：[ ] 中的部分為可缺省內容
（1）類屬表說明用以將信息參數傳遞到實體。最常用的信息是器件的上升沿到下降沿的延遲時間、負載電容和電阻、驅動能力以及功耗等。
（2）端口表指明實體的輸入、輸出信號及其模式。端口模式共有五種，如下所示。
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