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基于FPGA 視頻α 混合IP 的設(shè)計
(合肥工業(yè)大學(xué)微電子設(shè)計研究所 485 信箱 郵編：230009）
摘要：本文闡述了視頻α 混合IP 的設(shè)計和實現(xiàn)方法。為了改善電路的性能, 在設(shè)計中不僅
采用了雙通道和流水線技術(shù)，而且結(jié)合FPGA 芯片的結(jié)構(gòu)特點，采用了許多針對性的電路，并充分使用了FPGA 上的DSP 運算模塊。此IP 性能較高，且具有一定的通用性；它已經(jīng)在兩款FPGA 系統(tǒng)中得到了成功應(yīng)用，這對其它電路設(shè)計具有一定的借鑒意義。
關(guān)鍵詞：α 混合; 像素; FPGA; IP.
(合肥工業(yè)大學(xué)微電子設(shè)計研究所 485 信箱 郵編：230009）
摘要：本文闡述了視頻α 混合IP 的設(shè)計和實現(xiàn)方法。為了改善電路的性能, 在設(shè)計中不僅
采用了雙通道和流水線技術(shù)，而且結(jié)合FPGA 芯片的結(jié)構(gòu)特點，采用了許多針對性的電路，并充分使用了FPGA 上的DSP 運算模塊。此IP 性能較高，且具有一定的通用性；它已經(jīng)在兩款FPGA 系統(tǒng)中得到了成功應(yīng)用，這對其它電路設(shè)計具有一定的借鑒意義。
關(guān)鍵詞：α 混合; 像素; FPGA; IP.
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