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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>ISE時(shí)序約束

ISE時(shí)序約束

2010-01-11 | rar | 3444 | 次下載 | 10積分

資料介紹

ISE時(shí)序約束:What effects do timing constraints have on your project?
? The implementation tools do not attempt to find the place & route that will
obtain the best speed
– Instead, the implementation tools try to meet your performance
expectations
? Performance expectations are communicated with timing constraints
– Timing constraints improve the design performance by placing logic closer
together so shorter routing resources can be used
– Note that when we discuss using the Constraints Editor, we are referring to
the Xilinx Constraints Editor
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