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FPGA 原型設(shè)計人員艱苦努力所得的明顯回報就是 ASIC* 設(shè)計可以及時而毫無問題地完成產(chǎn)品定案(tape-out)。不過，原型設(shè)計還有一點日益重要的優(yōu)勢，即 ASIC 或 SoC 中嵌入的軟件在項目開發(fā)的早期階段便可與實際速度硬件進行完美集成。
為什么軟件團隊要關(guān)注 FPGA 原型設(shè)計問題
獨立的 EDA 分析師 Gary Smith 指出（見圖 1），SoC 采用的CMOS工藝節(jié)點日益小型化，而且技術(shù)越來越復(fù)雜，因此軟件組成部分已成為產(chǎn)品特色和開發(fā)焦點所在。進入市場的最新消費類器件多采用復(fù)雜的 SoC，其中包括眾多嵌入式處理器和幾十萬甚至數(shù)百萬行代碼。Apple iPhone 就是一個很好的例子，它至少包含 3 個 ARM 處理器。加速產(chǎn)品上市進程對產(chǎn)品推出至關(guān)重要，在此情況下，怎么才能在 SoC 環(huán)境中進行軟件驗證呢？
SoC 開發(fā)團隊越來越多地開始采用 FPGA 原型設(shè)計作為解決方案來進行驗證并及時推出各種類型的產(chǎn)品。
為什么軟件團隊要關(guān)注 FPGA 原型設(shè)計問題
獨立的 EDA 分析師 Gary Smith 指出（見圖 1），SoC 采用的CMOS工藝節(jié)點日益小型化，而且技術(shù)越來越復(fù)雜，因此軟件組成部分已成為產(chǎn)品特色和開發(fā)焦點所在。進入市場的最新消費類器件多采用復(fù)雜的 SoC，其中包括眾多嵌入式處理器和幾十萬甚至數(shù)百萬行代碼。Apple iPhone 就是一個很好的例子，它至少包含 3 個 ARM 處理器。加速產(chǎn)品上市進程對產(chǎn)品推出至關(guān)重要，在此情況下，怎么才能在 SoC 環(huán)境中進行軟件驗證呢？
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