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VHDL語言對基本電路行為的描述方法
VHDL語言主要是對設計對象進行描述
寄存器，邏輯模塊，芯片，印制板，系統
數字系統的哪些方面需要我們描述
接口：設計實體對外部的連接關系
功能：設計實體所進行的操作
接口是全部端口（port）的集合
Port是一種新的編程對象：信號
Port具有類型定義，如bit
Port具有工作模式定義：in， out， inout （雙向）
VHDL支持四種基本的對象類型：變量（variable），常量（constant），信號（ signal）和文件（file）
變量和常量類型
和傳統的編程語言定義一致
信號類型是針對數字系統的描述而定義的
與變量類型的區別在于信號值是與時間相聯系的
信號的內部表示是一個時間-值的序列！（該序列常被稱為信號的驅動序列）
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