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基于FPGA的高速FIR數(shù)字濾波器設(shè)計的改進方法_趙岸/顏毅華/陳林杰/劉東浩/王威/陳志軍

2015-04-17 | pdf | 1112KB | 次下載 | 2積分

資料介紹

在高速有限沖擊響應(yīng)( Finite Impulse Response,F(xiàn)IR) 數(shù)字濾波器的設(shè)計中,隨著濾波器階數(shù)的增加,保持數(shù)據(jù)流速率和有效使用硬件資源成為設(shè)計的一個重點和難點。基于高速并行有限沖擊響應(yīng)數(shù)字濾波器的基本原理,提出了一種將位平面法、正則有符號系數(shù)( Canonical-Signed Digit,CSD) 編碼算法和抽取算法應(yīng)用于并行有限沖擊響應(yīng)數(shù)字濾波器的改進方法。設(shè)計通過 Matlab 仿真,在 Quartus II 中編譯、仿真、綜合后下載到現(xiàn)場可編程門陣列( Field Programmable Gate Array,F(xiàn)PGA) 中進行測試,結(jié)果顯示,這種改進方法較好地解決了濾波器階數(shù)和數(shù)據(jù)流速率與硬件資源之間的關(guān)系。
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