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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于CPLD的LCD1602顯示系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

基于CPLD的LCD1602顯示系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

2015-08-24 | pdf | 3113KB | 次下載 | 免費(fèi)

資料介紹

為了提高LCD1602顯示效果,增強(qiáng)抗擾能力,文章基于TOP2812開發(fā)板,依據(jù)LCD1602操作時(shí)序要求,在開發(fā)板CPLD部分實(shí)現(xiàn)了LCD1602顯示系統(tǒng)的設(shè)計(jì)。文中對(duì)LCD1602時(shí)序進(jìn)行了詳細(xì)分析,并在Quartus II平臺(tái)下采用Verilog HDL編寫了test bench測(cè)試文件和驅(qū)動(dòng)程序,經(jīng)仿真和實(shí)際測(cè)試表明,顯示效果較好,達(dá)到了設(shè)計(jì)要求。
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