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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA的經典面試題和解答方法合集

FPGA的經典面試題和解答方法合集

2020-09-04 | rar | 0.16 MB | 次下載 | 免費

資料介紹

  1:什么是同步邏輯和異步邏輯?(漢王)

  同步邏輯是時鐘之間有固定的因果關系。異步邏輯是各時鐘之間沒有固定的因果關系。答案應該與上面問題一致

  〔補充〕:同步時序邏輯電路的特點:各觸發器的時鐘端全部連接在一起,并接在系統時鐘端,只有當時鐘脈沖到來時,電路的狀態才能改變。改變后的狀態將一直保持到下一個時鐘脈沖的到來,此時無論外部輸入x 有無變化,狀態表中的每個狀態都是穩定的。

  異步時序邏輯電路的特點:電路中除可以使用帶時鐘的觸發器外,還可以使用不帶時鐘的觸發器和延遲元件作為存儲元件,電路中沒有統一的時鐘,電路狀態的改變由外部輸入的變化直接引起。

  2:同步電路和異步電路的區別:

  同步電路:存儲電路中所有觸發器的時鐘輸入端都接同一個時鐘脈沖源,因而所有觸發器的狀態的變化都

  與所加的時鐘脈沖信號同步。異步電路:電路沒有統一的時鐘,有些觸發器的時鐘輸入端與時鐘脈沖源相連,這有這些觸發器的狀態變化與時鐘脈沖同步,而其他的觸發器的狀態變化不與時鐘脈沖同步。

  3:時序設計的實質:

  電路設計的難點在時序設計,時序設計的實質就是滿足每一個觸發器的建立/ 保持時間的而要求。

  4:建立時間與保持時間的概念?

  建立時間:觸發器在時鐘上升沿到來之前,其數據輸入端的數據必須保持不變的時間。

  保持時間:觸發器在時鐘上升沿到來之后,其數據輸入端的數據必須保持不變的時間。

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