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發(fā)視頻FPGA設(shè)計(jì)的基本流程和規(guī)范與驗(yàn)證方法詳細(xì)說(shuō)明
資料介紹
系統(tǒng)視剡和預(yù)算
系統(tǒng)功能的總體規(guī)劃：
功能集的定義
端口的定義;
模塊的基本劃分和功能定義：
·每個(gè)模塊應(yīng)該完成的功能
·模塊之間的接口定義
·模塊間通訊的問(wèn)題一定要考慮好，硬件通信的成本般比較大
設(shè)計(jì)的整體視劃設(shè)計(jì)規(guī)模的初步估計(jì)，大致應(yīng)該選擇哪一層次的設(shè)計(jì)時(shí)序的宏觀規(guī)劃頻率和時(shí)鐘結(jié)構(gòu);可能的關(guān)鍵路徑，著重優(yōu)化模塊的進(jìn)一步細(xì)化，考慮可重用性等的規(guī)劃：可以考慮基本單元，比如加法、乘法器和寄存器等
設(shè)計(jì)的整體視劃
設(shè)計(jì)規(guī)模的初步估計(jì)，大致應(yīng)該選擇哪一層次的芯片
設(shè)計(jì)時(shí)序的宏觀規(guī)劃
頻率和時(shí)鐘結(jié)構(gòu)
可能的關(guān)鍵路徑，著重優(yōu)化
模塊的進(jìn)一步細(xì)化，考慮可重用性等的規(guī)劃：
可以考慮基本單元，比如加法、乘法器和寄存器等
設(shè)計(jì)實(shí)現(xiàn)
用電路框圖或者HDL描述實(shí)現(xiàn)自己的設(shè)計(jì)：
簡(jiǎn)單的設(shè)計(jì)可以用電路框圖
大型復(fù)雜的一般傾向于用HDL描述
HDL描述和計(jì)算機(jī)編程中的高級(jí)語(yǔ)言描述有很大不同，每一個(gè)描述都要考慮硬件的實(shí)現(xiàn)能力，是不是可以綜合的等等，目前HDL語(yǔ)言標(biāo)準(zhǔn)中仍然有不能被綜合的語(yǔ)法，這些要尤其注意
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